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ICS9FG1200D-1
频率资本负债时钟为CPU ， PCIe一代，第二代& FBD
引脚配置
HIGH_BW ＃
CLK_IN
CLK_IN ＃
SMB_A0
OE0#
DIF_0
DIF_0#
OE1#
DIF_1
DIF_1#
VDD
GND
DIF_2
DIF_2#
OE2#
DIF_3
DIF_3#
OE3#
DIF_4
DIF_4#
OE4#
VDD
GND
DIF_5
DIF_5#
OE5#
SMB_A1
SMBDAT
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
VDDA
GNDA
IREF
OE10_11#
DIF_11
DIF_11#
VDD
GND
DIF_10
DIF_10#
FS_A_410
VTT_PWRGD ＃ / PD
OE9#
DIF_9
DIF_9#
OE8#
DIF_8
DIF_8#
VDD
GND
DIF_7
DIF_7#
OE7#
DIF_6
DIF_6#
OE6#
SMB_A2_PLLBYP#
SMBCLK
56引脚SSOP & TSSOP
电源组
引脚数
VDD
GND
56
55
11,22,38,50
12,23,37,49
描述
主PLL ，模拟
DIF时钟
在功能上电（ PLL模式）
CLK_IN （ CPU外频）
DIF_ （11 ：0）
兆赫
兆赫
1
100 < = CLK_IN < 200
CLK_IN
0
200< = CLK_IN < = 400
CLK_IN
1. FS_A_410是一个低阈值输入端。请参阅V
IL_FS
和V
IH_FS
规范中的输入/电源/通用输出参数表正确的价值观。
FS_A_410
1
IDT
频率资本负债时钟为CPU ， PCIe一代，第二代& FBD
9FG1200-1
1138C
02/08/10
2
