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SN75DP130
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SLLSE57
–
2011年4月
框图
VCC
CAD_SRC
CADout
卡丁
HPDIN
ADDR_EQ
R
inHPD
CAD_SNK
HPD_SNK
ADDR_EQ
VDDD
R
RST
=150k
HPD_SRC
VCC
VDDD （V
CORE
)
GND
50
HPDOUT
~130k
IN
OUT
V
ITERM
50
RESET
VREG
EN
R
EN
=200k
VCC
50
50
V
BIAS
RSTn低电平有效
EN
IN0p
IN0n
V
ITERM
50
50
EQ
DP ++
司机
OUT0p
OUT0n
V
BIAS
50
50
IN1p
EQ
DP ++
司机
OUT1p
OUT1n
V
BIAS
IN1n
V
ITERM
50
50
50
50
IN2p
IN2n
V
ITERM
50
50
50
EQ
DP ++
司机
OUT2p
V
BIAS
50
OUT2n
OUT3p
OUT3n
IN3p
IN3n
EQ
AMPL
PRE_EMP
OE
DP ++
司机
ADDR_EQ
SCL_CTL
SDA_CTL
I
2
C
目标
ADDR_EQ
HPDOUT
按Ctrl [3： 1]
卡丁
HPDIN
EN
OE
CTRL
CADout
VCC
EQ控制
PRE_EMP
R
DDC
AEQ （ LX）
注册
卡丁
R
DDC
卡丁
SCL_DDC
SDA_DDC
ctrl2
ctrl1
DPCD
训练
逻辑
AMPL
PRE_EMP
AUX_SRCp
AUX_SRCn
AUX_SNKp
AUX_SNKn
版权
2011年，德州仪器
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SN75DP130
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