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R
XC4000E和XC4000X系列现场可编程门阵列
写LCA
WS/CS0
阅读状态
RS , CS0
RS , CS1
WS , CS1
1
T
CA
2
3
T
DC
T
CD
7
准备
4
D7
D0-D7
CCLK
T
WTRB
4
RDY / BUSY
6
T
DOUT
前一个字节D6
D7
D0
D1
D2
X6097
RDY
描述
有效的写入时间
( CS0 , WS =低; RS , CS1 =高)
DIN建立时间
DIN保持时间
结束后, RDY / BUSY延迟
写或读
RDY / BUSY后开始活跃
的阅读
RDY / BUSY低输出(注4 )
符号
1
T
CA
2
3
4
7
6
T
T
DC
T
CD
T
WTRB
100
60
0
最大
单位
ns
ns
ns
ns
ns
CCLK
6
60
60
2
9
注意事项: 1, CON组fi guration必须延迟,直到所有的菊花链的FPGA的INIT引脚高。
2.从WS年底到CCLK周期数据的新字节的时间取决于完成前一个字节的
处理和CCLK的内部定时发生器的相位。
3. CCLK和DOUT定时在从模式下进行测试。
4. T
表示该双缓冲并行 - 串行转换器尚未准备好接收新数据。最短
T
当一个字节装入一个空的并行 - 串行转换器发生。最长的牛逼
发生在当一个新的字
被装入输入寄存器之前的第二级缓冲器已开始移出数据
此时序图显示很放松要求。数据不需要被保持超过的上升沿
WS
。 RDY /
结束后走在60纳秒活跃
WS
。 RDY后新的写,可以断言/
变低,但写
可能不会被终止之前,RDY /
一直居高不下一个CCLK周期。
图59 :异步外设模式编程开关特性
1999年5月14日(版本1.6 )
6-67

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