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R
XC4000E和XC4000X系列现场可编程门阵列
图41第44页
是XC4000系列的图
边界扫描逻辑。它包括数据寄存器三位
每IOB ,在IEEE 1149.1测试访问端口控制器,而
指令寄存器与解码。
XC4000系列器件还可以CON连接通过gured
边界扫描逻辑。看
55页上的“回读” 。
数据寄存器,分别与BSCANT.UPD ,这是
总是将数据寄存器中的最后一个比特。这三个bound-
元的扫描位是专用的Xilinx测试信号。
其它标准数据寄存器是一个IP- FL佛罗里达州运
旁路寄存器。它同步传递数据
通过FPGA至紧邻的下游边界扫描
装置。
该FPGA提供了两个额外的数据寄存器,可以
可以使用BSCAN宏观特定网络版。该FPGA提供
两个用户销( BSCAN.SEL1和BSCAN.SEL2 ),它们是
两个用户指令进行解码。对于这些指令,
两
相应
引脚
(BSCAN.TDO1
和
BSCAN.TDO2 )允许用户扫描数据要在移出
TDO 。数据寄存器时钟( BSCAN.DRCK )可
控制测试逻辑的,用户可以想实现
换货与CLB中。 TCK的NAND和RUN -TEST -IDLE
还提供了( BSCAN.IDLE ) 。
数据寄存器
主数据寄存器是边界扫描寄存器。为
每个IOB引脚在FPGA中,结合与否,它包括三个
位输入,输出和三态控制。非IOB引脚具有
适当偏位人口或缩小而已。 PRO-
GRAM , CCLK和DONE不包括在所述边界
扫描寄存器。每个EXTEST Capture-DR状态捕获
所有的输入,输出和三态引脚。
数据寄存器还包括以下的非针位:
TDO.T和TDO.O的,它总是位0和位1的
EXTEST
TS INV
TS / OE
边界
扫描
产量
倒置
产量
M
sd
输出继电器数据O
M
输出中的时钟确定
rd
M
M
S / R
倒置
M
OUT
SEL
D
EC
Q
TS - 捕捉
TS - 更新
M
SLEW
率
拉
下
拉
UP
三态TS
V
CC
6
PAD
时钟使能
边界
扫描
M
- 捕捉
Q - 捕捉
- 更新
我 - 捕捉
边界
扫描
我 - 更新
sd
D
延迟
M
触发器/ LATCH
输入时钟IK
M
输入
S / R
rd
EC
M
倒置
Q
L
Q
M M
M M
输入数据2 I2
输入数据1 I1
全球
S / R
X5792
图40 : XC4000E IOB与边界扫描结构图(一些细节未显示)。
XC4000X边界扫描逻辑是相同的。
1999年5月14日(版本1.6 )
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