Spartan-3系列FPGA系列：功能描述
R
DFS时钟输出连接
有确定如何连接两个基本例
在DFS时钟输出：片上和片外，它们是illus-
trated在
图19A
和
图19C ，
分别。这是
类似于已经描述为DLL的COM
分量。见
DLL时钟输出和反馈CON-
连接中，有
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部分。
在芯片上的情况下，也可以连接任一
DFS的两家通过通用布线输出时钟信号
资源到FPGA的内部寄存器。无论是全球
时钟缓冲器（ BUFG ）或BUFGMUX能提供到所述接入
全局时钟网络。形成可选的反馈回路
以这种方式，路由CLK0到全局时钟网络，这又
驱动CLKFB输入。
在离片的情况下，在DFS的两个输出时钟信号，加
CLK0用于可选的反馈回路，可以退出FPGA
使用输出缓冲器（ OBUF ）驱动时钟网络加
登记在黑板上。反馈环路由形成
那么，CLK0信号反馈到使用FPGA的
IBUFG ，直接访问全局时钟网络，或
一个IBUF 。然后，全局时钟网被直接连接到
在CLKFB输入。
PS组件启用和模式选择
该CLKOUT_PHASE_SHIFT属性使PS
组件除了使用两个之间进行选择
操作模式。如上述
表19
该属性
有三个可能的值：无，固定和可变。
当CLKOUT_PHASE_SHIFT设置为NONE ，则PS
禁用组件和它的输入， PSEN ， PSCLK和
PSINCDEC ，必须连接到GND 。在该组波形的
图21A
示出禁用的情况下，如果该DLL main-
tains信号CLKFB和CLKIN的零相位对准
在其上的PS部件没有任何作用。在PS的COM
分量是通过属性设置来启用任
固定或可变值，选择固定相
模式和可变相位模式，分别。这些
两种模式都在下面的章节中描述
确定精细相移
用户控制CLKFB相的相移，以
CLKIN通过设置和/或调节的值
PHASE_SHIFT属性。该值必须是整数
范围从-255到+255 。在PS组件使用此
值，计算所希望的精细的相移（T
PS
），为
在CLKIN周期的分数（T
CLKIN
） 。对于给定的值
相移和T
CLKIN
时，能够计算
PS
as
如下所示：
T
PS
= （ PHASE_SHIFT / 256 ） * T
CLKIN
(4)
无论是固定的相位和可变相位工作模式
采用此计算。如果PHASE_SHIFT值为零，
然后CLKFB和CLKIN将是同相的，相同的时
在PS组件禁用。当PHASE_SHIFT
值是正的， CLKFB信号将在后面移
时间相对于CLKIN 。如果该属性的值是负的，
在CLKFB信号将被较早就移入时间
到CLKIN 。
移相器（ PS ）
将DCM提供了两种方法来控制相
：DCM时钟输出相对于CLKIN信号的信号的
首先，有一些使用该DLL到9的时钟输出
实现期望的相位关系： CLK0 ， CLK90 ，
CLK180 ， CLK270 ， CLK2X ， CLK2X180 ， CLKDV CLKFX和
CLKFX180 。这些输出提供“粗”相位控制。
第二种方法使用中所描述的聚苯乙烯成分
此部分提供控制的更细度。该PS
组分是只有当DLL被在操作可用其
低频模式。在PS成分相移的
DCM输出时钟通过引入"fine相shift" （T
PS
)
DLL中CLKFB和CLKIN信号之间
组件。用户可向下控制这种精细的相移
到1/256或一个CLKIN周期的一个延时抽头的决议
（ DCM_TAP ） ，以较高者为准。在使用时，将PS
部分转移所有九个DCM时钟输出的相位
信号在一起。如果PS组件一起使用的
如CLK90 DCM的时钟输出， CLK180 ， CLK270 ，
CLK2X180和CLKFX180 ，当时的罚款相移
前者被添加到后者的粗相移。
表19：
PS属性
属性
CLKOUT_PHASE_SHIFT
PHASE_SHIFT
固定相位模式
此模式修复所需的细的相移来的一小部分
经t
CLKIN
如由等式（4）确定和其
用户选择的PHASE_SHIFT值P的集合的波形
形式
图21B
示的关系
CLKFB和CLKIN在固定相模式。在固定
相模式时， PSEN ， PSCLK和PSINCDEC输入是
不使用，必须连接到GND 。
描述
PS禁用组件或选择固定的相位之间
和可变相位模式。
确定尺寸和初始细的相移的方向。
值
NONE ，固定，可变
整数-255到+255
(1)
注意事项：
1.值的实际范围会少当T
CLKIN
> FINE_SHIFT_RANGE在固定相模式，也当T
CLKIN
＆ GT ;
（ FINE_SHIFT_RANGE ） / 2 ，在可变相位模式。在FINE_SHIFT_RANGE代表所有的水龙头的总和延迟。
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DS099-2 （ V2.4 ） 2008年6月25日
产品speci fi cation
