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ORCA
2系列的FPGA
数据表
1999年6月
使4位来自PLC的数据到读出的数据
总线。
该
ORCA
系列2系列也有一个新的功能
化可用于内存模式下每个PFU 。输入到
这个功能是在写使能（WE ）信号和
写端口使能（ WPE ）的信号。写使能显
纳尔为A4为HLUTA和B4为HLUTB ，而另一
输入到与门为HLUTs是将写
端口使能输入的C0或CIN 。一般地， WPE
输入由同一RAM存储使能信号驱动
控制每个PFU的比迪烟。
其中RAM银行选择将数据写入
不要求使用的LUT的其他PFU就能如
在以前的
ORCA
架构。这降低了num-
PFU就能完成的误码率要求的公羊大于16个字
深度。需要注意的是，如果任一HLUT是在MA / MB的模式，那么
同样WPE是积极为HLUTs 。
增加内存的字的大小（如16 ×8 ） ， 2
或多个PLC被再次使用。地址，直写
能和PLC的写使能端口绑
一起（逐位） ，并且该数据是对每一个不同的
PLC 。增加这两个地址位置和字
大小，通过使用这两个技的组合进行
niques 。
查找表可以同时用于两个存储器
与组合逻辑功能。图13示出了
使用LUT实现16× 2内存（ HLUTA ）和
高达科幻任何功能已经输入变量（ HLUTB ） 。
HLUTA
可编程逻辑单元
（续）
异步存储器模式-MA和MB
在PFU的LUT可以CON组fi gured因为无论是读/
写或只读存储器。读/写地址
（A [3：0 ]，B [ 3：0] ），写数据（WD [1： 0]， WD [3： 2]） ，和两个
写使能（WE ）端口用于存储器。在异步
异步的存储器模式中，每个HLUT可以作为一个
16× 2内存。每个HLUT是骗子网络gured indepen-
dently ，允许功能，例如一个16× 2存储器中
1 HLUT和网络连接的逻辑功能已经输入变量或
少在其他HLUT 。
图12示出了用于16× 4的使用LUT的
内存。时的LUT被用作存储器，有
是独立的地址，输入数据和输出数据
巴士。如果LUT被用作一个16 ×4的读/写MEM-
储器中，A [3：0 ]和B [3：0 ]端口的地址输入端
（ A [ 3 ： 0 ] ） 。 A4和B4端口写使能（ WE）
信号。对WD [3：0 ]输入是数据输入。该
F [ 3：0]的数据输出可以被路由列于-O [ 4：0]
PFU的输出或到锁存器/ FF D [ 3：0]输入。
WEA
A3
A2
A1
A0
WD3
WD2
WPE
A4
A3
A2
A1
A0
WD3
WD2 C0
HLUTA
F3
F2
WEA
WEB
WD1
WD0
B3
B2
B1
B0
B4
WD1
WD0
B3
B2
B1
B0
F1
F0
C0 HLUTB
A4
A3
A2
A1
A0
WD3
C0
QLUT2
F2
QLUT3
F3
A3
A2
A1
A0
WD3
WPE
HLUTB
5-2757(F).r3
图12. MA / MB模式， 16 ×4的RAM
为了增加超过16 （例如， 32×记忆单词的深度
4 ），两个或多个PLC都可以使用。的地址和
写数据输入，用于所述两个或多个PLC被拴
一起（逐位） ，并且将数据输出被路由
通过在每个PFU中可用的4个3 statable比迪烟
然后被捆绑在一起（点点滴滴） 。
3 statable比迪的控制信号，称作RAM
银行启用，是从上一个译码创建
地址位。拉姆银行启用，然后用于
12
B4
B3
B2
B1
B0
B4
B3
B2
B1
B0
QLUT0
QLUT1
F0
5-2845(F).a.r1
图13. MA / F5模式- 16× 2内存和一个
5个输入变量的函数
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