ADS6149/ADS6129
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SLWS211B - 2008年7月 - 修订2008年10月
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N+3
N+4
N+18
N+20
N+2
样品
N
输入
信号
t
a
N+1
N+19
输入
时钟
CLKP
CLKM
CLKOUTM
CLKOUTP
t
su
DDR
LVDS
输出数据
DXP ， DXM
E
O
E
O
E
O
18时钟周期*
t
h
t
PDI
E
O
E
O
E
O
E
O
E
N
O
E
N+1
O
E
N+2
O
ê - 偶数位D0 ， D2 ， D4 ， ...
- 奇位D1 ， D3 ， D5 ， ...
N–18
N–17
N–16
N–15
t
PDI
CLKOUT
t
su
18时钟周期*
t
h
N–14
N–1
N
N+1
N+2
并行
CMOS
输出数据
N–18
N–17
N–16
N–15
然后，整体延迟= ADC延迟+ 1 。
ADC的延迟是在低等待时间模式14个时钟周期。
T0105-09
图2.图延迟
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2008 ，德州仪器
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