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40MX和42MX FPGA系列
该42MX器件包含三种类型的逻辑模块：
组合（ C-模块） ，连续（S模块）和
解码
（四模块） 。
图1-2
说明
该
组合逻辑模块。在S-模块，在所示
图1-3 ，
实现相同的组合逻辑
函数的C -模块同时加入一个连续的
元素。顺序元件可以被配置为
任一个D触发器或一透明锁存器。在S-模块
注册可以绕过，使其实现纯
组合逻辑。
A0
B0
D00
D01
D10
D11
S1
A1
B1
Y
S0
图1-2
42MX C-模块实现
D00
D01
D10
D11
S1
S0
Y
D
CLR
Q
OUT
D00
D01
D10
D11
S1
S0
Y
D
门
Q
OUT
截至7输入功能加上D型触发器与Clear
截至7输入功能加上锁
D00
D0
Y
D1
S
D
门
CLR
Q
OUT
D01
D10
D11
S1
S0
Y
OUT
多达4个输入功能加上锁存与清除
最多8个输入功能（同C-模块）
图1-3
42MX S-模块实现
1 -2
v6.0
