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40MX和42MX FPGA系列
表38 -
A42MX36时序特性（标称5.0V操作）
（最坏情况下的商业条件，V
CCA
= 4.75V ，T
J
= 70°C)
' -3 '速度
'-2 '速度
“-1”速度
“标准”速度
“ -F ”速度
参数说明
分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。单位
同步SRAM操作（续）
t
ADH
t
RENSU
t
RENH的值为
t
温宿
t
WENH
t
BENS
t
BENH
地址/数据保持时间
读使能建立
读使能保持
写使能建立
写使能保持
块启用设置-UP
块使能保持
0.0
0.6
3.4
2.7
0.0
2.8
0.0
0.0
0.7
3.8
3.0
0.0
3.1
0.0
0.0
0.8
4.3
3.4
0.0
3.5
0.0
0.0
0.9
5.0
4.0
0.0
4.1
0.0
0.0
1.3
7.0
5.6
0.0
5.7
0.0
ns
ns
ns
ns
ns
ns
ns
异步SRAM的操作
t
RPD
t
RDaDv
t
ADSU
t
ADH
t
RENSUA
t
RENHA
t
温宿
t
WENH
t
DOH
异步访问时间
阅读地址有效
地址/数据建立时间
地址/数据保持时间
读使能设置到地址
有效
读使能保持
写使能建立
写使能保持
数据输出保持时间
8.8
1.6
0.0
0.6
3.4
2.7
0.0
1.2
8.1
9.8
1.8
0.0
0.7
3.8
3.0
0.0
1.3
9.0
11.1
2.0
0.0
0.8
4.3
3.4
0.0
1.5
10.2
13.0
2.4
0.0
0.9
5.0
4.0
0.0
1.8
12.0
18.2
3.4
0.0
1.3
7.0
5.6
0.0
2.5
16.8
ns
ns
ns
ns
ns
ns
ns
ns
ns
输入模块传输延迟
t
INPY
t
INGO
t
INH
t
INSU
t
ILA
注意事项：
1.对于双宏模块，使用吨
PD1
+ t
RD1
+ t
PDN
, t
CO
+ t
RD1
+ t
PDN
或T
PD1
+ t
RD1
+ t
SUD
，适当的指令。
2.路由延迟对于典型设计跨最坏情况下的运行工况。这些参数应该被用于估计
器件的性能。布线后的时序分析或模拟需要确定实际性能。
3.数据适用于基于S-模块的宏。从C -模块，构建了连续的宏时序参数可
从定时程序获得。
4.设置和保持时间参数为输入缓冲器锁存器被定义为相对于所述PAD和D输入端。外部设置/
持定时参数必须考虑从外部PAD信号的G输入端延迟。从外部PAD信号延迟
对G输入减去（增加）的内部设置（保持）时间。
5.延迟基于35 pF的负载。
输入数据垫到-Y
输入锁存门到输出
输入锁存保持
输入锁存建立
锁存主动脉冲宽度
0.0
0.5
4.7
1.0
1.4
0.0
0.5
5.2
1.1
1.6
0.0
0.6
5.9
1.3
1.8
0.0
0.7
6.9
1.5
2.1
0.0
1.0
9.7
2.1
2.9
ns
ns
ns
ns
ns
1 -7 0
v6.0
