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MPC8533E概述
四家银行的内存支持，每个高达4千兆字节，最大为16 GB的
从64兆到4千兆位由x8 / x16的数据端口DRAM芯片配置
完整支持ECC
页模式支持
- 多达16个同时打开的页面的DDR
- 多达32个同时打开页面DDR2
- 连续或非连续的内存映射
- 自我刷新SDRAM睡眠模式的支持
- 片上终端支持时，使用DDR2
- 支持自动清爽
- 在的即时功率管理使用CKE信号
- 注册的DIMM支持
- 通过JTAG端口快速内存访问
- 2.5 -V SSTL_2兼容的I / O（ 1.8 -V SSTL_1.8为DDR2 ）
可编程中断控制器（ PIC）的
- 编程模型是符合的OpenPIC架构。
- 支持16个可编程的中断和处理器的任务优先级
- 支持12离散外部中断
- 支持4消息， 32位的消息中断
- 支持的外部中断控制器的连接，如8259的可编程
中断控制器
- 四个全球高分辨率定时器/计数器，可以产生中断
- 支持各种其它内部中断源
- 全面支持嵌套中断交付
- 中断可以被路由到外部引脚用于外部处理。
- 中断可以被路由到e500内核的标准或关键的中断输入。
- 总结中断寄存器允许快速识别中断源。
集成安全引擎（ SEC）的优化处理所有与安全相关的算法，
IKE， WTLS / WAP， SSL / TLS和3GPP
- 四个加密通道，每个通道支持多命令描述符链
- 对加密执行单元通过一个集成控制器的动态分配
- 缓冲区256字节为每个执行单元的大小，对大数据量的流量控制
- PKEU公共密钥执行单元
- RSA和Diffie -Hellman的;可编程领域规模高达2048位
- 对于F椭圆曲线密码
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M和F（ P）模式和可编程领域规模达
511位
- 申 - 数据加密标准执行单元
- DES ， 3DES
MPC8533E的PowerQUICC III集成处理器的硬件规格，第3版
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飞思卡尔半导体公司
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