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版本2.04 - 2007年9月7日
405GPr - Power PC的405GPr嵌入式处理器
数据表
信号功能描述
（共8页6 ）
复用的信号示于下面的分配给每一复用球的第一信号名称括号。
注意事项：
1.接收器输入具有滞后性。
2.必须拉起来。请参阅“上拉和下拉电阻”第29页上推荐的终止值。
3.必须拔下来。请参阅“上拉和下拉电阻”第29页上推荐的终止值。
4.如果不使用，必须拉起。
5.如果不使用，必须拔下来。
6.复位期间捆包输入;上拉或根据需要往下拉。
7.拉可能需要。请参阅第29页上的“外部总线控制信号” 。
信号名称
UART1_Tx
UART1串行数据输出。
UART1的数据设置就绪
or
UART1清除发送。要使用此功能，软件必须切换
一个DCR位。
UART1请求发送
or
UART1的数据终端就绪。要使用此功能，软件必须
切换一个DCR位。
IIC串行时钟。
IIC串行数据。
描述
I / O
O
TYPE
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
笔记
6
UART1_DSR/
UART1_CTS
I
1
UART1_RTS/
UART1_DTR
O
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
6
IICSCL
IICSDA
I / O
I / O
1, 2
1, 2
中断接口
中断请求
or
通用I / O 。要使用此功能，软件必须切换一个
DCR位。
5V容限
3.3V LVTTL
IRQ0 ：6 GPIO17 ： 23]
我[I / O]
1
JTAG接口
TDI
TMS
TDO
TCK
TRST
测试数据。
JTAG测试模式选择。
测试数据输出。
JTAG测试时钟。该输入的频率范围可从直流到
25MHz.
JTAG复位。 TRST必须是低电源接通时初始化JTAG
控制器和用于PPC405GPr的正常运行。
I
I
O
I
I
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
1, 4
5
1, 4
1, 4
系统接口
系统时钟
主系统时钟输入。
主系统复位。外部逻辑可以推动这个双向引脚为低电平
（最小的16个周期）来启动一个系统复位。系统复位即可
也可以通过软件来启动。实现为漏极开路输出
（两种状态， 0或开路） 。
干净的电压输入为PLL 。
干净的地面输入的PLL 。
设置为1时，生成的机器检查。
从外部调试器暂停。
I
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
SYSRESET
I / O
1, 2
AV
DD
AGND
SYSERR
停止
I
I
O
I
5V容限
3.3V LVTTL
5V容限
3.3V LVTTL
1, 2
AMCC
35
