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注册240PIN DDR2 SDRAM DIMM内存模块
引脚说明
针
CK0
CK0
CKE0~CKE1
RAS
CAS
WE
S0,S1
A0~A9,A11~A13
A10/AP
BA0 ， BA1 ， BA2
SCL
SDA
SA0~SA2
Par_In
Err_Out
RESET
CB0~CB7
引脚说明
时钟输入，正极线
时钟输入，负线
时钟使能输入
行地址选通
列地址选通
写使能
片选输入
地址输入
地址输入/ Autoprecharge
SDRAM行地址
串行存在检测（ SPD ）时钟输入
SPD数据输入/输出
E
2
PROM的地址输入
奇偶校验位的地址和控制总线
在地址奇偶校验错误发现
复位使能
数据选通输入/输出
针
ODT [1：0 ]
VDDQ
DQ0~DQ63
CB0~CB7
DQS(0~8)
DQS(0~8)
DM(0~8),DQS(9~17)
DQS(9~17)
俄罗斯足协
NC
TEST
VDD
VDDQ
VSS
VREF
VDDSPD
引脚说明
片上终端输入
的DQ电源
数据输入/输出
数据校验位输入/输出
数据选通信号
数据选通信号，负线
数据Maskes /数据选通信号
数据选通信号，负线
留作将来使用
无连接
内存总线测试工具（未连接，并且不
可用的DIMM上）
核心动力
I / O电源
地
基准电源
电源的防雷器
引脚位置
针＃ 1
正面
针＃ 64
针＃ 65
针＃ 120
针＃ 121
背面
针＃ 184
针＃ 185
针＃ 240
修订版0.2 / 2008年9月
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