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NT256S72V89A0G
256MB ： 32M X 72
UNBUFFERED SDRAM模块
引脚说明
CK0 ， CK2
CK1 ， CK3
CKE0
时钟输入
未使用的（终止）时钟输入
时钟使能
行地址选通
列地址选通
写使能
芯片选择
地址输入
地址输入/ Autoprecharge
SDRAM行地址输入
DQ0-DQ63
CB0-CB7
DQMB0-DQMB7
V
DD
V
SS
NC
SCL
SDA
SA0-2
WP
数据输入/输出
校验位的数据输入/输出
数据屏蔽
电源（ 3.3V ）
地
无连接
串行存在检测时钟输入
串行存在检测数据输入/输出
串行存在检测地址输入
串行存在检测写保护输入
RAS
CAS
WE
S0
,
S2
A0-A9, A11, A12
A10 / AP
BA0 ， BA1
引脚
针
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
前
V
SS
DQ0
DQ1
DQ2
DQ3
V
DD
DQ4
DQ5
DQ6
DQ7
DQ8
V
SS
DQ9
DQ10
DQ11
DQ12
DQ13
V
DD
DQ14
DQ15
CB0
CB1
V
SS
NC
NC
V
DD
针
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
后
V
SS
DQ32
DQ33
DQ34
DQ35
V
DD
DQ36
DQ37
DQ38
DQ39
DQ40
V
SS
DQ41
DQ42
DQ43
DQ44
DQ45
V
DD
DQ46
DQ47
CB4
CB5
V
SS
NC
NC
V
DD
针
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
前
DQMB1
针
113
114
115
116
117
118
119
120
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
后
DQMB5
NC
针
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
前
DQ18
DQ19
V
DD
DQ20
NC
NC
NC
V
SS
DQ21
DQ22
DQ23
V
SS
DQ24
DQ25
DQ26
DQ27
V
DD
DQ28
DQ29
DQ30
DQ31
V
SS
CK2
NC
WP
SDA
SCL
V
DD
针
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
后
DQ50
DQ51
V
DD
DQ52
NC
NC
NC
V
SS
DQ53
DQ54
DQ55
V
SS
DQ56
DQ57
DQ58
DQ59
V
DD
DQ60
DQ61
DQ62
DQ63
V
SS
*CK3
NC
SA0
SA1
SA2
V
DD
S0
NC
V
SS
A0
A2
A4
A6
A8
A10/AP
BA1
V
DD
V
DD
CK0
V
SS
NC
RAS
V
SS
A1
A3
A5
A7
A9
BA0
A11
V
DD
*CK1
A12
V
SS
CKE0
NC
DQMB6
DQMB7
NC
V
DD
NC
NC
CB6
CB7
V
SS
DQ48
DQ49
S2
DQMB2
DQMB3
NC
V
DD
NC
NC
CB2
CB3
V
SS
DQ16
DQ17
WE
DQMB0
CAS
DQMB4
注：所有的引脚分配是所有8个字节的无缓冲的版本是一致的。校验位（ CB0 - CB7 ）仅适用于X72的DIMM;
* CK1和CK3被终止。
初步
09 / 2001
2
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南亚科技股份有限公司。
