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恩智浦半导体
LPC2104/2105/2106
单芯片32位微控制器
使用双边沿控制PWM输出，特定连接C匹配寄存器控制上升和
落入输出的边缘。这样就产生了正脉冲（当上升沿
边缘之前出现下降沿）和负向脉冲（当下降沿
边前发生的上升沿） 。
6.17.1特性
7个匹配寄存器，可实现6个单边沿控制或3个双边沿
控制PWM输出，或这两种类型的混合。
匹配寄存器允许：
–
连续操作，可选择产生中断比赛。
–
停止比赛，可选择产生中断定时器。
–
匹配时复位定时器，可选择产生中断。
支持单边沿控制和/或双边沿控制的PWM输出。单身
边沿控制PWM输出变为高电平，在每个周期，除非一开始
输出是一个恒定的低电压。双边沿控制PWM输出可任意边缘
发生在一个周期内的任何位置。这允许同时产生正和负
脉冲。
脉冲周期和宽度可以是任何的定时器计数值。这使得完整
灵活性在分辨率和重复率之间的权衡。所有PWM输出将
发生在相同的重复频率。
双边沿控制PWM输出可被编程为正持续
脉冲或负脉冲。
匹配寄存器更新与脉冲输出，以防止产生同步
错误的脉冲。软件必须在发布新的匹配值，才可以成为
有效的。
可作为一个标准定时器如果不使能PWM模式。
32位定时器/计数器，一个可编程的32位预分频器。
6.18系统控制
6.18.1晶体振荡器
该振荡器支持1 MHz至25 MHz范围内的晶体。振荡器的输出
频率称为FOSC和ARM处理器的时钟频率被称为CCLK
为了速率方程等FOSC和CCLK值是相同的，除非PLL
连接并运行。请参阅
第6.18.2节“ PLL”
了解更多信息。
6.18.2 PLL
PLL可以接受在10 MHz至25 MHz范围内的输入时钟频率。输入
频率被倍增为10MHz到60MHz的范围内具有一个电流受控
振荡器（ CCO ） 。乘法器可以是从1至32 （在实际中的整数值，则
由于上倍频值不能超过6这一系列微控制器更高
CPU的频率限制） 。 CCO的操作在156 MHz至320 MHz范围内，所以
有在循环中一个额外的分频器使CCO保持在其内的频率范围内，而
所述PLL提供所期望的输出频率。输出分频器可设置来划分
LPC2104_2105_2106_7
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牧师07 - 2008年6月20日
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