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SRAM
奥斯汀半导体公司
AS5SS128K36
功能框图
17
SA0 ， SA1 ， SA
地址
注册
17
SA1
D1
SA0
D0
ADV / LD \\
15
SA1'
Q1 SA0 “
Q0
BURST
逻辑
17
17
17
模式
CLK
CKE \\
K
CE
K
写地址
注册
ADV / LD \\
BWA \\
BWB \\
BWC \\
BWD \\
R / W \\
128K ×9× 4
写入注册表及
数据一致性
控制逻辑
写
DRIVERS
内存
ARRAY
S
E
N
S
E
A
M
P
S
D
A
T
A
S
T
E
E
R
I
N
G
O
U
T
P
U
T
B
U
F
F
E
R
S
E
的DQ
OE \\
CE \\
CE2
CE2\
读
逻辑
输入
E
注册
注意：
该功能框图给出了简化设备操作。见真值表，引脚说明和时序图详细
信息。
AS5SS128K36
2.0版本12/00
奥斯汀半导体公司保留更改产品或规格，恕不另行通知。
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