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莱迪思半导体公司
图11. ispXPGA PIO
仅适用于公共信息官与sysHSI块相关
从sysHSI块
从sysHSI块
馈通（ FT ）
从输入的sysIO
时钟（CLK）
输入时钟使能（ ICEN ）
输入置位/复位（ ISR ）
环球置位/复位（ GSR ）
延迟
D
CLK / LE
CE
S R
Q
ispXPGA系列数据手册
为了路由
OUT0
OUT1
要的sysIO
产量
PIO的输入（IN ）
D
CLK / LE
Q
要sysHSI
块
输出时钟使能（ OCEN ）
输出置位/复位（ OSR ）
CE
S R
仅适用于公共信息官
关联
sysHSI块
要sysHSI
块
要的sysIO
产量
启用
PIO输出使能（ OEN ）
D
CLK / LE
CE
Q
S R
PIO输入使能（ IEN ）
OE
VLI路由资源
该ispXPGA架构包含一个可变长度互连（ VLI ）路由技术连接PFU就能完成，
的PIC ，并在该装置EBRS 。有四种类型的布线资源，全球线路，线路长，一般互
连接和本地线路形成全局路由结构。这允许信号被路由到任何元件
该装置具有最佳延迟。
全球线条组成的全局时钟线和全局置位/复位线。这些线被路由到所有的元素
该设备。他们具体来说专为高速，可预测的时序不管扇出。全局时钟
线也可以用作专用的输入。
排长队由水平和垂直线长（ HLL和VLL ）中。该VLL和HLL的三态线
跨越整个设备。这些生产线可以实现快速路由高扇出网络和通用的功能。
通用互连由双和十溴系的。双回线路连接最多三个要素（ 2
加的驱动元件），而十溴线连接多达11个元件（ 10加在驱动元件） 。
本地线条组成的反馈和直连线路速度极快的路由路径。反馈
线是从PFU输出到PFU输入内部路由路径。直接连接线连接所有相邻
分元素。
通用接口模块（ CIB ）提供了逻辑单元（ PFU ， PIC ，或EBR）和VLI之间的联系
布线资源。 CIB中是可以进行编程，以几乎任何路由资源连接到一个开关矩阵
任何输入或逻辑元件的输出。
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