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初步
集成
电路
系统公司
ICS85314-01
L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
输入
输出
选定的源
CLK0 ， nCLK0
CLK1
CLK0 ， nCLK0
Q0:Q4
启用
启用
残疾人;低
nQ0 ： nQ4
启用
启用
残疾人; HIGH
T
ABLE
3A 。
ONTROL
I
NPUT
F
油膏
T
ABLE
nCLK_EN
0
0
1
CLK_SEL
0
1
0
1
1
CLK1
残疾人;低
残疾人; HIGH
nCLK_EN开关后，时钟输出被禁用或启用下面的上升沿和下降沿的输入时钟边沿
如图1中所示。
在主动模式下，输出的状态是的CLK0 ， nCLK0和CLK1输入的函数描述
在表3B中。
残
nCLK0
CLK0 ， CLK1
启用
nCLK_EN
nQ0 ： nQ4
Q0:Q4
F
IGURE
1 - nCLK_EN牛逼
即时通信
D
IAGRAM
T
ABLE
3B 。
LOCK
I
NPUT
F
油膏
T
ABLE
输入
CLK0或CLK1
0
1
0
1
偏见;注1
偏见;注1
nCLK0
1
0
偏见;注1
偏见;注1
0
1
Q0:Q4
低
高
低
高
高
低
输出
nQ0 ： nQ4
高
低
高
低
低
高
输入到输出模式
差分至差分
差分至差分
单端至差分
单端至差分
单端至差分
单端至差分
极性
非铟（Inver）婷
非铟（Inver）婷
非铟（Inver）婷
非铟（Inver）婷
INVER婷
INVER婷
注1 ：请参考应用信息， "Wiring的差分输入接受单端Levels" 。
85314AG-01
www.icst.com/products/hiperclocks.html
3
REV 。 B 2002年6月21日
