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初步
集成
电路
系统公司
ICS85314-01
L
OW
S
KEW
, 1-
TO
-5
D
。微分
-
TO
-2.5V / 3.3V LVPECL F
ANOUT
B
UFFER
TYPE
描述
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
差分输出对。 LVPECL接口电平。
负电源引脚。
时钟选择输入。当HIGH ，选择SCLK输入。
下拉低电平时，选择CLK ， NCLK输入。
LVTTL / LVCMOS接口电平。
无连接。
上拉
INVER婷差分时钟输入。
下拉非INVER婷差分时钟输入。
下拉时钟输入。 LVTTL / LVCMOS接口电平。
T
ABLE
1. P
IN
D
ESCRIPTIONS
数
1, 2
3, 4
5, 6
7, 8
9 , 10
11
12
13, 17
14
15
16
18, 20
名字
Q0 ， nQ0
Q1 ， NQ1
Q2 ， NQ2
Q3 ， nQ3
Q4 ， nQ4
V
EE
CLK_SEL
nc
nCLK0
CLK0
CLK1
V
CC
产量
产量
产量
产量
产量
动力
输入
未使用
输入
输入
输入
动力
正电源引脚。
同步时钟使能。低电平时，时钟输出时钟跟随
19
nCLK_EN
输入
下拉输入。高时，Q输出被强制低， NQ输出被强制
高。 LVTTL / LVCMOS接口电平。
注意：
上拉
和
下拉
是指内部输入电阻。见表2 ，引脚特性，为典型值。
T
ABLE
2. P
IN
C
极特
符号
C
IN
R
上拉
R
下拉
参数
输入电容
输入上拉电阻
输入下拉电阻
51
51
测试条件
最低
典型
最大
4
单位
pF
K
K
85314AG-01
www.icst.com/products/hiperclocks.html
2
REV 。 B 2002年6月21日
