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初步
集成
电路
系统公司
ICS8430-111
700MH
Z
, L
OW
J
伊特尔
D
。微分
-
TO
-3.3V LVPECL F
Characteristic低频
S
YNTHESIZER
并行输入模式。 VCO的频之间的关系
昆西，输入频率和M个除法器被定义为
如下： FVCO = F
IN
×M的
M值和M0通过M8所需要的值
所示
表3B ，
可编程VCO频率功能
表。有效的M值的量， PLL才能实现锁定为一个
16MHz的基准定义为100
≤
M
≤
350.频率
出的定义如下： fOUT的= FVCO = F
IN
×M的
N
N
发生串行操作时nP_LOAD为高和S_LOAD
为LOW 。该移位寄存器是通过采样S-DATA装
比特与S_CLOCK的上升沿。的内容
移位寄存器被加载到M个除法器和N个输出分频器
当从低到高的S_LOAD过渡。在M鸿沟
和N分频的输出值被锁存在HIGH到LOW
S_LOAD的过渡。如果S_LOAD是在保持高电平，数据
S-DATA输入被直接传递到M分频器和N个输出
分压器上S_CLOCK的每个上升沿。串行模式
用于编程的M和N位测试位T1和T0的。
内部寄存器T0和T1确定的状态
T1
0
0
1
1
T0
0
1
0
1
测试输出
低
S-DATA ，移位寄存器输入
M个分频器输出
CMOS的F out
F
UNCTIONAL
D
ESCRIPTION
该ICS8430-111拥有一个完全集成的PLL和there-
前无需外部元件设置循环
带宽。一个差分时钟输入被用作输入到
片上振荡器。该振荡器的输出除以16
前的相位检测器。 A16MHz时钟输入提供了一个
1MHz的基准频率。 PLL的VCO的工作过
的范围为200至700MHz的。 M个除法器的输出也是
施加到相位检测器。
相位检测器和M个分频器迫使VCO输出
频率为2M次调整基准频率
荷兰国际集团VCO控制电压。需要注意的是对于M的一些值
（过高或过低）时，PLL将不实现锁定。该
VCO的输出由除法器被发送到前缩放
每个LVPECL输出缓冲器。分频器提供
50 ％的输出占空比。
的ICS8430-111支持两个可编程功能
输入模式进行编程并购分频器和N分频器的输出。
两个输入的操作模式是并行和串行。
图 -
URE 1
示出了每种模式的时序图。在
并行模式nP_LOAD输入最初为低电平。上的数据
通过N2输入M0通过M8和N0直接传递
到M分频器和N分频器的输出。在低到高
该nP_LOAD输入的跳变时，数据被锁存， M个
分保持加载直到下一个从高到低的跳变
nP_LOAD或直至串行事件发生。其结果是，M个
和N位可以硬连线来设置对M分频器和N个输出
分隔到一个特定的默认状态就会自动发生
在上电期间。在运行时，测试输出为低电平
S
ERIAL
L
OADING
S_CLOCK
S-DATA
t
S_LOAD
S
t
H
nP_LOAD
t
S
P
ARALLEL
L
OADING
M0 ： M8 ， N0 ： N1
nP_LOAD
M，N
t
S_LOAD
S
t
H
时间
F
IGURE
1. P
ARALLEL
＆放大器; S
ERIAL
L
OAD
O
PERATIONS
*注意：
8430DY-111
空时隙定时必须遵守。
www.icst.com/products/hiperclocks.html
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REV 。 F 2005年6月1日
