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ADS8329
ADS8330
SLAS516 - 2006年12月
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操作原理（续）
SCLK的占空比不是关键的，只要它满足了8 ns的最小高电平和低电平时间的要求。
由于ADS8329 / 30被设计用于高速应用中，较高的串行时钟（SCLK）必须提供给
能够维持高吞吐量的串行接口等SCLK的时钟周期必须在最
1
s
（作为转换时钟（CCLK ）一起使用时，该最小时钟频率也由寄生管辖
泄漏的电容数字 - 模拟（ CDAC ）电容器内部向ADS8329 / 30 。
CFR_D10
转换时钟
（ CCLK ）
=1
OSC
SPI串行
时钟（SCLK）
=0
分频器
1/2
图54.转换器时钟
手动频道选择模式
在转换周期开始通过写入信道号来的命令选择一个捕获信道
寄存器（ CMR ） 。这个周期时间可短至4个串行时钟（SCLK） 。
自动信道选择模式
频道选择，也如果启用自动信道选择模式可以自动完成。这是默认
通道选择模式。双通道转换器， ADS8330 ，具有一个内置的2对1多路复用器。如果该设备是
编程信号，然后从通道0和通道1与固定的收购自动信道选择模式
顺序。通道0的第一次被访问的下一个周期中构造CFR_D11为1的命令周期后
自动信道选择模式。这种自动进入停止循环，设置CFR_D11指令周期之后
为0。
启动转换的
采集或取样实例（EOS）的端部是相同的转换的开始。这是通过启动
使CONVST引脚为低电平最少40纳秒。最低要求被满足后，将
CONVST引脚可以带来很高。 CONVST充当独立的FS / CS因此它可能使用一个公共的
CONVST为需要同时采样应用/将与多个转换器。该ADS8329 / 30
从样品的交换机上的CONVST信号的下降沿保持模式。该ADS8329 / 30需要18个
转换时钟（ CCLK）边来完成转换。转换时间相当于1500 ns时
12 - MHz的内部时钟。连续两个CONVST信号之间的最短时间为21个CCLK 。
A转换，也可以不使用CONVST如果是这样编程的（ CFR_D9 = 0）开始。当
转换器被配置为自动触发，下一次转换是自动启动3转换时钟（ CCLK ）
一个转换结束之后。这3个转换时钟（ CCLK）被用作采集时间。在这种情况下
的时间来完成一次采集和转换周期是21个CCLK。
转换表1.不同类型
模式
选择通道
自动信道选择
(1)
自动
不需要写的信道数的CMR 。使用内部音序器的
ADS8330.
手册
(1)
手动通道选择
写的信道号到CMR 。
开始转换
自动触发
开始基于该转换
转换时钟CCLK 。
手动触发
开始CONVST转换。
自动信道选择应自动触发使用，并与标签位使能。
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