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AD9238
（通过门控，分频或其它方法） ，应当由重定时
在最后一步骤中的原始时钟。
出院0.1 μF至10 μF的REFT去耦电容
和REFB 。
单通道可断电的中等功率
节约。在已关闭通道关闭内部
电路，但两者的基准电压缓冲和共享参考
保持通电。因为缓冲器和电压参考
继续供电，唤醒时间缩短到几
时钟周期。
功耗和待机模式
由AD9238的功耗正比于它的
采样率。数字（ DRVDD ）功耗
主要由数字驱动器的强度来确定和
每个输出位的负载。数字驱动电流可
通过计算
I
DRVDD
=
V
DRVDD
×
C
负载
×
f
时钟
×
N
哪里
N
是比特改变的数量，并
C
负载
是平均
加载在数字引脚改变。
模拟电路被最佳偏置，使得每个速度
等级提供了出色的性能，同时提供降低
功耗。每个速度等级消耗的基线
电源在低采样率的时钟频率增加。
在AD9238的任一通道可以置于待机模式
自主断言PDWN_A或PDWN_B引脚。
建议在输入时钟（S）和模拟输入（多个）
独立或总待机期间保持不变，这
结果在1毫瓦的典型功率消耗为ADC 。
需要注意的是，如果DCS启用，它是强制性禁用时钟
一个独立的断电通道。否则，
显著的失真效果的有效通道。如果时钟
投入保持在总待机模式激活时，典型功耗
消耗12 mW的结果。
最小待机功率时实现两个信道
被置于完全关断模式（ PDWN_A = PDWN_B
= HI ） 。在这种状态下，内部的引用是动力
下来。当任一个或两者的信道路径被启用
断电后，唤醒时间直接相关的
的REFT和REFB去耦电容充电
和掉电的持续时间。通常情况下，它需要
大约5毫秒恢复全面运作与充分
A
–1
A
0
A
1
A
2
数字输出
的AD9238输出驱动器可以被配置为与对接
2.5 V或3.3 V逻辑匹配DRVDD为数字
电源的接口逻辑。输出驱动器的尺寸设置成
提供足够的输出电流以驱动各种逻辑电路的
家庭。然而，大的驱动电流趋向于使电流
故障可能影响转换器的性能。
要求ADC应用来驱动较大的容性负载
或较大扇出可能需要外部缓冲器或锁存器。
的数据格式可以被选择用于任何偏移二进制或二进制补码
补充。更多信息请参见数据格式部分。
定时
该AD9238提供锁存数据输出与流水线延迟
的7个时钟周期。数据输出可用1 propa-
gation延迟（T
PD
）后，在时钟信号的上升沿。参考
图2为一详细的时序图。
内部占空比稳定器可在AD9238启用
使用DCS引脚。这提供了一个稳定的50％的占空比，以
内部电路。
输出数据线和负载放置在它们的长度
应该被最小化，以减少AD9238中的瞬变。
这些瞬变可以从转换器的动态减损
性能。在AD9238的典型最低转换速率
1 MSPS 。在低于1 MSPS时钟速率，动态性能
可能会降低。
A
8
A
7
A
4
A
5
A
6
模拟量输入
ADC A
A
3
B
–1
B
0
B
1
B
2
B
8
B
3
B
4
B
5
B
7
B
6
模拟量输入
ADC B
CLK_A = CLK_B =
MUX_SELECT
B
–8
A
–7
B
–7
A
–6
B
–6
A
–5
B
–5
A
–4
B
–4
A
–3
B
–3
A
–2
B
–2
A
–1
B
–1
A
0
B
0
A
1
D0_A TO
D11_A
02640-066
t
PD
t
PD
图33.复用的数据格式使用通道A输出和相同的时钟绑CLK_A ， CLK_B和MUX_SELECT
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