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ADS6445 ， ADS6444
ADS6443 ， ADS6442
SLAS531 - 2007年5月
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捕获测试格局
ADS644X输出比特时钟（ DCLK ） ，位于近的数据转变的中心。建议
路由比特时钟，帧时钟和输出数据线与PCB上的最小相对偏斜。这保证
充足的建立/保持时间的可靠捕获由接收器。
偏斜校正是1010 ...或0101 ...上，可用于验证是否在串行数据线图案输出
接收机捕获时钟边沿的位置正确。这可能是有间有些歪斜的情况下是有用
DCLK和接收器内的串行数据。一旦反序列化时，需要确保该并行数据是
对准到帧边界。在SYNC测试图案可以被用于此目的。例如，在1线接口，
SYNC模式是7 '1'后面7 0（按照从MSB到LSB的顺序） 。此信息可用于由接收器
逻辑移位反序列化的数据，直到它的SYNC模式匹配。
除了去歪斜和SYNC ，所述ADS644X包括其他测试模式，以验证是否正确
由接收器捕捉，如全零，全部是一肘。这些模式是在所有四个通道的数据输出
线路同时进行。如自定义和同步模式的一些受接口类型的选择，
序列化和位阶。
表25.测试模式
图案
全零
全一
切换
风俗
SYNC
歪斜校正
输出逻辑低电平。
输出逻辑高电平。
输出切换模式 - 10101010101010之间<D13 - D0>交替
01010101010101每个时钟周期。
输出一个14位自定义模式。 14位定义模式可以被指定成两个
串行接口寄存器。在2线接口，每个代码被发送过的2根金属丝
根据不同的序列化和位阶上。
输出一个同步模式。
输出偏移校正模式。无论是<D13 - D0> = 10101010101010或<D11 - D0> =
01010101010101每个时钟周期。
描述
表26.同步模式
接口
选项
1-Wire
2-Wire
序列化
14 X
16 X
14 X
16 X
同步模式每根电线
MSB-11111110000000-LSB
MSB-111111111000000000-LSB
MSB-1111000-LSB
MSB-11110000-LSB
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