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ADS62P45 ， ADS62P44
ADS62P43 ， ADS62P42
SLAS561A - 2007年7月 - 修订2008年2月
常见地块（续）
所有地块都在25 ° C， AVDD = DRVDD = 3.3 V ，正弦波输入时钟， 1.5 V
PP
差分时钟的幅度， 50 ％时钟占空比
周期，-1 dBFS的差分模拟输入，内部基准模式，增益为0 dB ， CMOS输出接口（除非另有说明）
DRVDD电流（ CMOS ）与
采样频率
横跨在2 MHz的输入频率负载电容
60
50
3.3 V ，空载
1.8 V ， 5 pF的
1.8 V ， 10 pF的
40
3.3 V ， 5 pF的
30
20
10
1.8 V ，空载
0
0
25
50
75
100
125
G079
DRV
DD
电流 - 毫安
3.3 V ， 10 pF的
f
S
- 采样频率 - MSPS
图79 。
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