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ADS62P45 ， ADS62P44
ADS62P43 ， ADS62P42
SLAS561A - 2007年7月 - 修订2008年2月
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典型特性 - 低采样频率
所有地块都在25 ° C， AVDD = DRVDD = 3.3 V ，正弦波输入时钟， 1.5 V
PP
差分时钟的幅度， 50 ％时钟占空比
周期，-1 dBFS的差分模拟输入，内部基准模式，增益为0 dB ， CMOS输出接口（除非另有说明）
F
S
= 25 MSPS
SFDR与输入频率
100
95
增益= 3.5分贝
80
78
76
SNR与输入频率
SNR - dBFS的
SFDR - dBc的
90
85
80
75
70
0
25
50
75
100
125
150
175
200
G075
74
72
增益= 0分贝
增益= 0分贝
增益= 3.5分贝
70
68
66
0
25
50
75
100
125
150
175
200
G076
f
IN
- 输入频率 - MHz的
f
IN
- 输入频率 - MHz的
图75 。
图76 。
常见PLOTS
所有地块都在25 ° C， AVDD = DRVDD = 3.3 V ，正弦波输入时钟， 1.5 V
PP
差分时钟的幅度， 50 ％时钟占空比
周期，-1 dBFS的差分模拟输入，内部基准模式，增益为0 dB ， CMOS输出接口（除非另有说明）
功耗与
采样频率（ DDR LVDS和CMOS ）
1.0
0.9
f
IN
= 2.5兆赫
C
L
= 5 pF的
LVDS
共模抑制比与频率
0
10
P
D
- 功耗 - W
20
30
0.8
0.7
0.6
0.5
0.4
0.3
0.2
0.1
0.0
CMRR - dBc的
40
50
60
70
80
90
100
0
25
50
75
100
125
150
175
200
G077
CMOS
0
25
50
75
100
125
G078
的F - 频率 - 兆赫
f
S
- 采样频率 - MSPS
图77 。
图78 。
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