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405CR的PowerPC嵌入式控制器数据表
I / O连接特定的阳离子， 200MHz的
注意事项：
1.双周期的SDRAM命令接口进行驱动周期1和用于周期2，输出时间在表中是在第1周期。
2. SDRAM的输出定时是相对于内部PLB时钟的上升沿，这是的整数倍和rising-
边缘与SysClk时钟对齐。因此， SDRAM的输出定时在表中示出相对于SysClk时钟。显示计时
是为一个集总50pF的负载，但是该接口已被用于PC100兼容使用操作传输验证
线电路分析。
3. SDRAM CLK0 ： 1上升沿封装引脚之前的内部时钟小巴约0.5ns的一个典型的时钟
网络或者一个集总10pF的负载。
4. PerClk上升的封装引脚边沿用10pF的负载约0.8ns落后于内部PLB时钟。
输入（纳秒）
信号
建立时间保持时间
（最小） （最小）
输出（ NS ）
有效的延迟
（最大）
50pF的负载
7.3
5.8
7.3
4.7
6.2
6
6
7.8
0
6.2
7.4
7.4
8
不适用
9
10
8
9
10
8
10.5
8
不适用
8
8
8
不适用
8
8
不适用
不适用
0.9
不适用
保持时间
（最小）
50pF的负载
1
1
1
1
1
1
1
1
-1
1
1
1
0
不适用
0
0
0
0
0
0
0
0
不适用
0
0
0
不适用
0
0
不适用
不适用
0.9
不适用
输出电流（mA ）
I / O ^ h
（最大）
I / 0 1
（最小）
时钟
笔记
SDRAM接口
BA0 ： 1
BankSel0 ： 3
CAS
ClkEn0 ： 1
DQM0 ： 3
DQMCB
ECC0 ： 7
MemAddr12 ： 0
MemClkOut0 ： 1
MemData0 ： 31
RAS
WE
DMAAck0 ： 3
DMAReq0 ： 3
EOT0 ：3 TC0 ：3]
PerAddr0 ： 31
PerBLast
PerCS0
PerCS1 ：7 GPIO10 ： 16]
PerData0 ： 31
PerOE
PerPar0 ： 3
PERR / W
PerReady
PerWBE0 ： 3
BUSREQ
ExtAck
EXTREQ
ExtReset
HOLDACK
HoldPri
HOLDREQ
PERclk
PerErr
不适用
不适用
不适用
不适用
不适用
不适用
2
不适用
不适用
2
不适用
不适用
不适用
dc
dc
4
4
不适用
6
不适用
4
5
9
4
不适用
不适用
6
不适用
不适用
4
6
不适用
4
不适用
不适用
不适用
不适用
不适用
不适用
1
不适用
不适用
1
不适用
不适用
不适用
dc
dc
1
1
不适用
1
不适用
1
1
1
1
不适用
不适用
1
不适用
不适用
1
1
不适用
1
19
19
19
40
19
19
19
19
19
19
19
19
12
不适用
12
19
12
12
19
12
19
12
不适用
12
12
12
不适用
19
12
不适用
不适用
19
不适用
12
12
12
25
12
12
12
12
12
12
12
12
8
不适用
8
12
8
8
12
8
12
8
不适用
8
8
8
不适用
12
8
不适用
不适用
12
不适用
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
系统时钟
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PERclk
PLB的Clk
PERclk
4
1, 2
2
1, 2
2
2
2
2
1, 2
2, 3
2
1, 2
1, 2
外部从外设接口
外部主机外设接口
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