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CY7C1317CV18 ， CY7C1917CV18
CY7C1319CV18 ， CY7C1321CV18
引脚德网络nitions
引脚名称
DQ
[x:0]
IO
引脚说明
输入输出 -
数据的输入输出信号。
输入采样的K和K时钟有效的写在上升沿
同步操作。在读操作期间，这些引脚输出所请求的数据。有效数据被赶出来的
无论是C和C时钟在读操作或K和K上升沿时，在单时钟模式。
读访问时取消，Q
[x:0]
自动为三态的。
CY7C1317CV18
DQ
[7:0]
CY7C1917CV18
DQ
[8:0]
CY7C1319CV18
DQ
[17:0]
CY7C1321CV18
DQ
[35:0]
输入 -
同步加载。
该输入为低电平时，总线周期序列定义。这个定义
同步包括地址和读/写方向。所有交易在一阵4的数据（两个时钟周期操作
总线活动的） 。
输入 -
半字节写选择0,1
低电平有效（只CY7C1317CV18 ） 。
采样在K的上升沿
在写操作的同步和K时钟。用于选择高半字节中的写入设备
的写操作的当前部分。不写半字节保持不变。
NWS
0
控件D
[3:0]
和NWS
1
控件D
[7:4]
.
所有的半字节写选择采样的相同沿的数据。取消一个半字节写选择
忽略数据的对应半字节，并且不写入到器件中。
输入 -
字节写选择0 ， 1 ， 2 ， 3
低电平有效。
采样的K和K时钟在上升边缘
同步写操作。用于选择哪个字节写入当前部分中写入设备
操作。不写入的字节保持不变。
CY7C1917CV18
BWS
0
控件D
[8:0]
CY7C1319CV18
BWS
0
控件D
[8:0]
和BWS
1
控件D
[17:9].
CY7C1321CV18
BWS
0
控件D
[8:0]
， BWS
1
控件D
[17:9]
， BWS
2
控件D
[26:18]
和BWS
3
控制
D
[35:27]
.
所有的字节写选择采样的相同沿的数据。取消选择一个字节写选择
忽略数据的对应字节，并且不写入到器件中。
输入 -
地址输入。
这些地址输入复用于读取和写入操作。在内部，
同步装置被组织为CY7C1317CV18和2M ×9 2M ×8 （每512K ×8 4阵列） （每4阵列
为512K ×9 ）的CY7C1917CV18 ， 1M ×18 （每256K ×18 ）的CY7C1319CV18 ，和512K 4阵列
×36 （ 4阵列的每一个128K ×36 ），用于CY7C1321CV18 。
CY7C1317CV18 - 因为地址的至少两个显著的内部位为“00 ”，只有19个外部
需要地址输入到访问整个存储器阵列。
CY7C1917CV18 - 因为地址的至少两个显著的内部位为“00 ”，只有19个外部
需要地址输入到访问整个存储器阵列。
CY7C1319CV18 - A0和A1的输入突发计数器。这些都是在内部加
线性的方式。需要20个地址输入到访问整个存储器阵列。
CY7C1321CV18 - A0和A1的输入突发计数器。这些都是在内部加
线性的方式。需要19个地址输入到访问整个存储器阵列。
输入 -
同步读/写输入。
当LD为低时，该输入指定的访问类型（读时
同步R / W为高电平，写当R / W为低电平）加载地址。 R / W必须满足建立和保持时间
围绕K的边缘
输入时钟
正向输入时钟的输出数据。
C被结合使用C至时钟输出从读数据
该设备。 C和C一起使用，以纠偏各种设备的飞行时间在黑板上回
到控制器。看
应用实例
第10页了解更多信息。
负输入时钟的输出数据。
C被结合使用C至时钟输出从读数据
该设备。 C和C一起使用，以纠偏各种设备的飞行时间在黑板上回
到控制器。看
应用实例
第10页了解更多信息。
正向输入时钟输入。
的K上升沿用于捕获同步输入到装置
并推动了通过Q数据
[x:0]
在单时钟模式下。所有访问都在上升开始
K的边缘
负输入时钟输入。
K被用于捕获同步的数据被提供给该装置，并
开车出的数据通过Q
[x:0]
在单时钟模式下。
第31 6
LD
NWS
0
,
NWS
1
BWS
0
,
BWS
1
,
BWS
2
,
BWS
3
A, A0, A1
读/写
C
C
输入时钟
K
输入时钟
K
输入时钟
文件编号： 001-07161修订版* B
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