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ORCA
4系列的FPGA
数据表
2006年5月
产品说明
（续）
嵌入式
块RAM
嵌入式
微处理器
接口（MPI ）
高速I / O的
系统总线
取而代之
嵌入式IP
核心FPSCs
时钟引脚
（四侧）
PFU
SLIC
PLC
PIO
PIC
FPGA / SYSTEM
总线接口
锁相环
（ ALL 4
的角）
注意：对于FPSCs ，所有的I / O和右侧装置的4个PLL被替换为嵌入芯。
5-7536(F)a
图1. 4系列顶级图
可编程逻辑单元
PLC的排列成行和列的阵列。一个可编程控制器的位置由它的行和列表示
使得PLC中的第二行中的第三列是R2C3 。实际PLC的每个设备的阵列开始
与R3C2在所有4系列通用的FPGA。 PIO被设在FPGA上的所有四个侧面。每个组四个的PIO
在器件边缘具有相关联的PIC 。
该PLC由PFU ， SLIC和路由资源。一个PLC中的每个PFU包含八个
4输入（ 16位）的LUT ，八个锁存器/ FFs的，以及一个附加的FF即可以独立地或与算术运算
功能。该PFU是PLC的主逻辑元件，其含有两种组合和时序元件
逻辑。组合逻辑是位于PFU的LUT完成。该PFU可用于在不同模式下，以满足昼夜温差
同的逻辑要求。该LUT的双四核架构提供了一个反面的网络连接可配置中型/大型粮食architec-
TURE可用于从一个到八个独立的组合逻辑功能或大量实施
复杂的逻辑功能使用多个查找表。该
灵活性
LUT的处理很宽的输入功能，以及
多个较小的输入功能，最大限度地提高每PFU的门数，同时提高系统的运行速度。
在PFU组织在一个双四核时尚：两套四个LUT和农民田间学校，可以独立控制。
每个PFU有两个独立的可编程时钟，时钟使能，当地的置位/复位和数据选择。
的LUT还可以使用快速进位链逻辑在任一4位或8位的组合用于在算术函数使用
模式。搬出任一模式下的可在第九FF进行流水线进行登记。每个PFU还可CON组
科幻gured
作为一个同步32×4单或双端口RAM或ROM 。农民田间学校（或锁存器）可以从LUT获得输入
从可逆PFU输入输出，或直接，或它们可以拉高或者拉低。农民田间学校还具有可编程
时钟极性，时钟使能和当地的置位/复位。
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莱迪思半导体公司
