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OX16C950 REV B
8
T
变送器
＆放大器;
ECEIVER
FIFO
S
FCR [2] ：同花顺THR
逻辑0
没有变化。
逻辑1
冲THR的内容，在同一
地FCR [ 1 ]做为RHR 。
发射器和接收器具有相关联的保持
寄存器（ FIFO的） ，被称为发送器保持
寄存器（ THR）和接收器保持寄存器（ RHR ）
分别。
在正常操作中，当发送器完成
传输一个字节它将从顶部取出下一个数据
能THR和进行发送。如果THR是空的，
它将等待直到数据被写入到其中。如果THR是空的
正在传输的最后一个字符已经完成
（即发送移位寄存器为空）发送器
说是空闲的。类似地，当接收完成
接收一字节后，将其转移到RHR的底部。
如果RHR满了，就会发生溢出条件（见
第9.3节） 。
数据被写入到THR队列的底部，并读
从RHR队列的顶部完全异步
到发射机和接收机的操作。
各FIFO的大小是依赖于所述的设定
FCR寄存器。当在字节模式下，只有这些FIFO
接受一次一个字节表示它们是前
充分;这是与16C450兼容。当在FIFO中
模式下，FIFO的大小可以是16（以兼容
在16C550 ）或128 。
数据写入THR当它是完全丢失。数据读取
从RHR为空时是无效的。空或满
FIFO的状态都显示在状态行
注册“ LSR ” （参见9.3节） 。中断可
生成或DMA的信号可以被用来传送数据
向/从FIFO中。项目中每个FIFO的数量可
也可以读出从发射器FIFO水平回（ TFL ）
和接收FIFO水平（ RFL ）寄存器（见15.2 ） 。
8.1
DMA传输信令：
FCR [3] ： DMA信令模式/发送触发电平使
逻辑0
DMA模式'0'。
逻辑1
DMA模式'1'。
注：在DMA模式0 ，发送触发电平
始终设置为1，从而忽视FCR [ 5：4]和TTL 。
可以使用的TXRDY ＃生成的DMA控制信号
和RXRDY ＃引脚。它们的操作定义如下：
该TXRDY ＃引脚没有迟滞和简单地激活
使用一个比较操作。当UART处于DMA
模式0 （或字节模式）时， TXRDY ＃输出引脚有效
（低）时THR为空的，否则是无效的。
当DMA模式1， TXRDY ＃引脚处于非活动状态（高）
当THR是完整的，否则是活性，表明
有房的发送FIFO 。
该RXRDY ＃引脚可与滞后操作。在DMA
模式0 （或字节模式） ， RXRDY ＃才有效（低）
当RHR中包含的数据。当DMA模式1然而，
的操作如下：
1.
RXRDY ＃设置为活动时，重建家庭联系已达到
接收中断触发电平或超时事件有
发生（见10.3 ），它仍然有效，只要
作为RHR不为空。
RXRDY ＃设置为无效时， RHR为空。它
保持该状态，直到条件1时。
2.
FIFO控制寄存器“ FCR ”
FCR [ 0] ：启用FIFO模式
逻辑0
字节模式。
逻辑1
FIFO模式。
该位应设置FIFO触发前启用
的水平。
FCR [1] ：同花顺RHR
逻辑0
没有变化。
逻辑1
冲RHR的内容
这仅仅是执行时已经以FIFO方式。该
之间变化时RHR自动刷新
字节模式和FIFO模式。这个位将返回到零
后清空FIFO 。
数据表修订版1.2
FCR [ 5：4] ： THR触发电平
通常在450 ， 550 ，扩展550和950的模式，这些
位未使用（见第5节对模式的定义） 。在650
模式，它们定义了发送中断触发水平，
在750模式FCR [ 5 ]增加了FIFO的大小。
450 ， 550和550扩展的模式：
发射机中断触发等级被设置为1，并
FCR [ 5：4]被忽略。
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