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集成
电路
系统公司
ICS9LPR501
引脚说明（续）
针＃
17
18
19
20
21
22
23
引脚名称
SRCT1/SE1
SRCC1/SE2
GND
VDDPLL3_IO
SRCT2/SATAT
SRCC2/SATAC
GNDSRC
TYPE
OUT
OUT
PWR
PWR
OUT
OUT
PWR
描述
差分SRC1时钟对/ 3.3V单端输出的真实时钟。在上电默认为100
兆赫SRC ， -0.5 ％ downspread 。引脚功能可以通过SMBus B1b基因被改变[4： 1]
差分SRC1时钟对/ 3.3V单端输出时钟的补充。在通电
默认值是100 MHz的SRC ， -0.5 ％ downspread 。各引脚的功能可以通过SMBus改变
B1b[4:1]
接地引脚SRC / SE1和SE2时钟， PLL3 。
电源为PLL3输出。 VDDPLL3_IO为1.05 3.3V与±5 ％的容差
差分SRC / SATA时钟对真实时钟。
差分SRC / SATA时钟对时钟的补充。
接地引脚SRC时钟。
差SRC时钟对/时钟请求控制下或者SRC0或SRC2对真实时钟
所述电默认是SRCCLK3输出，但该引脚也可以用作时钟请求
控制SRC对0或SRC对2通过SMBus的。在配置此引脚作为时钟请求
引脚时， SRC3输出必须先在4个字节禁用的SMBus位地址空间的7 。后
SRC3输出时，该引脚可以被设置为作为时钟请求引脚或者SRC
对2或0对使用CR ＃ _C_EN位位于SMBUS地址空间的字节5 。
字节5 ，第3位
0 = SRC3启用（默认）
1 = CR ＃ _C启用。字节5 ，第2位的控制CR ＃ _C是否控制SRC0或SRC2对
字节5 ，第2位
0 = CR ＃ _C控制SRC0对（默认） ，
1 = CR ＃ _C控制SRC2对
差SRC时钟对/时钟请求控制D对任何SRC1互补时钟
或SRC4对
所述电默认是SRCCLK3输出，但该引脚也可以用作时钟请求
控制SRC对1或SRC对4通过SMBus的。在配置此引脚作为时钟请求
引脚时， SRC3输出必须先在4个字节禁用的SMBus位地址空间的7 。后
SRC3输出时，该引脚可以被设置为作为时钟请求引脚或者SRC
对1或使用CR ＃ _D_EN对4位位于SMBUS地址空间的字节5 。
5个字节，比特1
0 = SRC3启用（默认）
1 = CR ＃ _D启用。字节5位0控制CR ＃ _D是否控制SRC1或SRC4对
字节5中，第0位
0 = CR ＃ _D控制SRC1对（默认） ，
1 = CR ＃ _D控制SRC4对
电源为SRC时钟。 VDDSRC_IO为1.05 3.3V与±5 ％的容差
差SRC时钟对4真正的时钟
差SRC时钟对4的补钟
接地引脚SRC时钟。
差SRC时钟对真实时钟。
差SRC时钟对时钟的补充。
SRC11补/时钟请求控制SRC9对
所述电默认是SRC11 ＃ ，但该引脚也可以用作一个时钟请求控制
通过SMBus SRC9 。配置该引脚为时钟请求引脚时， SRC11输出对前
首先必须以字节为3禁用，第7位的SMBus配置空间后的SRC11输出
禁用（高阻） ，该引脚可以被设置作为使用字节时钟请求SRC9对
6 ，位SMBus的配置空间的5
字节6 ，第5位
0 = SRC11 ＃启用（默认）
1 = CR ＃ _G控制SRC9
24
SRCT3/CR#_C
I / O
25
SRCC3/CR#_D
I / O
26
27
28
29
30
31
VDDSRC_IO
SRCT4
SRCC4
GNDSRC
SRCT9
SRCC9
PWR
I / O
I / O
PWR
OUT
OUT
32
SRCC11/CR#_G
I / O
1118E—08/08/07
3
