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集成
电路
系统公司
ICS950211
可编程定时控制中心为P4
推荐应用：
代尔和代尔 - G芯片组的P4处理器。
输出特点：
3 - 的差的CPU时钟对（差分电流模式）
5 - 3V66 @ 3.3V
10 - PCI 3.3V @
2 - 为48MHz @ 3.3V固定
1 - REF @ 3.3V ， 14.318MHz
1 - VCH / 3V66 @ 3.3V ， 48 MHz或66.6 MHz的
特点/优势：
可编程输出频率。
可编程输出分频比。
可编程输出上升/下降时间。
可编程输出歪斜。
可编程扩频百分比EMI控制。
看门狗定时器技术来重置系统
如果系统出现故障。
可编程看门狗安全的频率。
我支持
2
C索引读/写和块读/写操作。
使用外部14.318MHz晶振。
关键的特定连接的阳离子：
CPU输出抖动<150ps
3V66输出抖动<250ps
CPU输出偏斜<100ps
引脚配置
VDDref
X1
X2
GND
1
PCICLK_F0
1
PCICLK_F1
PCICLK_F2
VDDpci
GND
1
*WDEN/PCICLK0
PCICLK1
PCICLK2
PCICLK3
VDDpci
GND
PCICLK4
PCICLK5
PCICLK6
VDD3V66
GND
3V66_2
3V66_3
3V66_4
3V66_5
* PD ＃
VDDA
GND
* VTT_PWRGD ＃
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
REF
FS1
FS0
CPU_STOP ＃ *
CPUCLKT0
CPUCLKC0
VDDcpu
CPUCLKT1
CPUCLKC1
GND
VDDcpu
CPUCLKT2
CPUCLKC2
MULTSEL0*
I REF
GND
FS2
48MHz_USB/FS3**
48MHz_DOT
AVDD48
GND
3V66_1/VCH_CLK/FS4**
PCI_STOP ＃ *
3V66_0
VDD
GND
SCLK
SDATA
1
56引脚300mil的SSOP & 240万TSSOP
1.这些输出具有2X驱动力。
*的120K内部上拉电阻连接到VDD
**这些投入有120K内部下拉
到GND
框图
PLL2
48MHz_USB
48MHz_DOT
X1
X2
XTAL
OSC
3V66_1/VCH_CLK
REF
PLL1
传播
SPECTRUM
WDEN
PD ＃
CPU_STOP ＃
PCI_STOP ＃
MULTSEL0
FS（ 4：0 ）
SDATA
SCLK
VTT_PWRGD ＃
中央处理器
Divder
停止
3
3
频率表
FS3 FS4 FS2 FS1 FS0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
CPUCLK
兆赫
66.66*
100.00
200.00
133.33
100.90
105.00
109.00
114.00
117.00
127.00
130.00
132.50
205.00
170.00
180.00
190.00
3V66
兆赫
66.66
66.66
66.66
66.66
67.27
70.00
72.67
76.00
78.00
72.86
74.29
75.71
70.00
56.67
60.00
63.33
PCICLK
兆赫
33.33
33.33
33.33
33.33
33.63
35.00
36.33
38.00
39.00
36.43
37.14
37.89
35.00
28.33
30.00
31.67
CPUCLKT （2 ：0）
CPUCLKC （2 ：0）
PCICLK （6 ：0）
PCICLK_F （2 ：0）
PCI
Divder
停止
7
3
控制
逻辑
3V66
Divder
5
3V66 (5:2, 0)
I REF
CONFIG 。
注册。
有关更多的频率选择，请参考字节0 。
*
对于950211BF版本，这个频率是166.66MHz 。
电源组
0465E—05/17/05
VDDA =模拟核心PLL
VDDREF = REF ，的Xtal
AVDD48 = 48MHz的
ICS950211
