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时钟
系统VCO频率=
csb_clk
× VCO分频器
如上述
第22条， “时钟”
在复位的LBCM ， DDRCM和SPMF参数
配置字低， CFG_CLKIN_DIV配置输入信号选择之间的比率
主时钟输入（CLKIN或PCI_CLK ）和内部一致的系统总线时钟（ csb_clk ） 。
表70
显示了预期的频率值的CSB频率选择
csb_clk
到CLKIN / PCI_SYNC_IN
比。
表70. CSB频率选项
输入时钟频率（MHZ ）
2
CFG_CLKIN_DIV
在复位
1
SPMF
csb_clk
:
输入时钟
比
2
16.67
25
33.33
66.67
csb_clk
频率（MHz）
低
低
低
低
低
低
低
低
低
低
低
低
低
低
低
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
0000
2:1
3:1
4:1
5:1
6:1
7:1
8:1
9:1
10 : 1
11 : 1
12 : 1
13 : 1
14 : 1
15 : 1
16 : 1
100
116
133
150
166
183
200
216
233
250
266
100
125
150
175
200
225
250
275
300
325
100
133
166
200
233
266
300
333
133
200
266
333
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飞思卡尔半导体公司
