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系统设计信息
PORESET
从目标
董事会来源
（如果有的话）
SRESET
HRESET
10 kΩ
PORESET
SRESET
HRESET
13
11
HRESET
SRESET
NV
DD
NV
DD
10 kΩ
NV
DD
10 kΩ
NV
DD
10 kΩ
1
3
5
7
9
11
2
4
6
8
10
12
4
6
1
5
15
TRST
2 kΩ
TRST
VDD_SENSE
NC
CHKSTP_OUT
NV
DD
CHKSTP_OUT
10 kΩ
NV
DD
10 kΩ
NV
DD
14
2
CHKSTP_IN
COP头
8
TMS
9
1
3
7
2
10
12
16
NC
NC
NC
TDO
TDI
TCK
关键
13
无引脚
CHKSTP_IN
TMS
TDO
TDI
TCK
15
16
COP连接器
物理引脚输出
注意事项：
1.某些系统需要的功率可以从应用程序板送入调试中继卡
通过COP头。在这种情况下为VDD_SENSE电阻值应约为20Ω 。
2.关键位置;销14不是缔约方会议标题上实际存在。
图42. JTAG接口连接
MPC8313E的PowerQUICC
II Pro处理器硬件规格，第0版
86
飞思卡尔半导体公司
