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功能描述和应用信息
HCLK
内部信号 - 仅用于说明的目的示出
hsel_weim_cs[0]
HTRANS
序列/非序列
HWRITE
读
HADDR
HREADY
weim_hrdata
weim_hready
V1
最后的有效数据
V1
BCLK （突发时钟）
ADDR
CS2
读/写
最后有效的地址
V1
读
LBA
OE
EBX
1
（ EBC
2
=0)
EBX
1
（ EBC
2
=1)
数据
V1
注1点：x = 0，1， 2或3个
注2 ： EBC =字节使能控制的片选控制寄存器位（ 11 ）
图10. WSC = 1， A.HALF / E.HALF
MC9328MXS技术数据，第3版
30
飞思卡尔半导体公司
