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C167CR
C167SR
并行端口
该C167CR提供高达被组织成八个输入/输出111 I / O线
端口和一个输入端口。所有端口线可位寻址，所有的输入/输出线
分别（按位）作为可编程通过方向寄存器输入或输出。在I / O
端口是切换时的高阻抗状态，真正的双向口
配置为输入。的5个I / O端口的输出驱动器可以配置（通过引脚引脚）
通过控制寄存器推/拉操作或漏极开路操作。在内部
复位后，所有端口引脚配置为输入。
端口2 ，端口3 ，端口7和端口8的输入阈值是可选择的（ TTL或CMOS等），
其中特殊的CMOS像输入阈值降低噪声灵敏度，由于输入
滞后。输入阈值可以被单独地选择为的每个字节
相应的端口。
所有端口线有关联的可编程复用输入或输出功能
他们。未用于这些复用功能的所有端口线可以用作一般
通用IO线。
访问外部当端口0和端口1可被用作地址线和数据线
内存，而4端口输出的附加段地址位A23 / 19/ 17 ... A16中
其中，分段启用访问超过64千字节的内存系统。
端口2 ，端口和8端口7 （和零件的PORT1 ）与捕获输入相关联或
比较的CAPCOM单元和/或与PWM模块的输出端输出。
端口6提供了可选的总线仲裁信号（ BREQ ， HLDA ，持有）和片选
信号。
端口3包括定时器复用功能，串行接口，可选的总线控制
信号BHE / WRH ，并且系统时钟输出（ CLKOUT） 。
口5 ，用于将模拟输入通道的A / D转换器或定时器控制信号。
该C167CR的端口驱动器的边缘特性（转换时间）可以选择
通过端口驱动控制寄存器（ PDCR ） 。两位选择快速边沿（' 0 '）或降低
边缘（ ' 1 '）总线接口引脚和非总线引脚分开。
PDCR.0 = BIPEC控制PORT0 ， PORT1 ，端口4 ， RD ， WR ， ALE ， CLKOUT ， BHE / WRH 。
PDCR.4 = NBPEC控制端口3 ，端口8 ， RSTOUT ， RSTIN （双向，复位模式）。
数据表
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V3.2, 2001-07
