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飞思卡尔半导体公司
特定网络阳离子
串行主机接口( SHI) SPI协议时序
表2-12
串行主机接口( SHI) SPI协议时序(续)
特征
模式
SLAVE
滤波器
模式
绕过
WIDE
绕过
WIDE
绕过
WIDE
绕过
WIDE
50兆赫
表达
最小值最大值最小值最大值最小值
T
C
+ T
H
+ 35
T
C
+ T
H
+ 35
T
C
+ T
H
+ 35
6
0
0
T
C
+ 6
T
C
+ 70
T
C
+ 197
2
66
193
65
65
65
6
0
0
26
90
217
2
66
193
0
17
32
0
18
33
57
58
68
57
58
68
4
24
41
214
504
41
214
504
70
246
541
58
58
58
6
0
0
21
85
212
2
66
193
0
22
37
0
23
38
47
48
58
47
48
58
4
24
41
214
504
41
214
504
63
239
534
53.5
53.5
53.5
6
0
0
18.3
82.4
209
2
66
193
0
25
40
0
26
41
41.7
42.7
52.7
41.7
42.7
52.7
4
最大
24
41
214
504
41
214
504
58.5
235
530
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
66兆赫
81兆赫
单位
146 SS断言到第一
SCK边缘CPHA = 0
CPHA = 1
SLAVE
飞思卡尔半导体公司...
147最后一个SCK边沿到SS
不能断言
CPHA = 0
CPHA = 1
3
SLAVE
SLAVE
148数据输入有效到SCK
EDGE(数据在建立
时间)
主绕过
0
窄MAX { ( 37 - T的
C
),
0}
WIDE
MAX { ( 52 - T的
C
),
0}
从旁路
0
窄MAX { ( 38 - T的
C
),
0}
WIDE
MAX { ( 53 - T的
C
),
0}
主绕过
WIDE
从旁路
WIDE
SLAVE
SLAVE
2
2
2
2
2
2
149 SCK边沿到数据输入
无效
(数据保持时间)
×
×
×
×
×
×
T
C
+ 17
T
C
+ 18
T
C
+ 28
T
C
+ 17
T
C
+ 18
T
C
+ 28
4
24
150 SS断言到数据
了积极的
151 SS Deassertation到
数据高阻抗
4
152 SCK边沿到数据输出旁路大师
有效(数据输出延时
时间)
WIDE
2
从旁路
CPHA = 0 , CPHA = 1
WIDE
CPHA = 1
从旁路
WIDE
41
214
504
41
214
504
T
C
+ T
H
+ 40
T
C
+ T
H
+ 216
T
C
+ T
H
+ 511
2-24
DSP56004 / D ,第3版
欲了解更多有关该产品,
转到: www.freescale.com
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