摩托罗拉
飞思卡尔半导体公司
半导体技术资料
通过订购此文件：
DSP56004 / D ，第3版
DSP56004
DSP56004ROM
SYMPHONY
音频DSP系列
24位的数字信号处理器
摩托罗拉设计了交响乐系列高性能，可编程的数字信号
处理器（DSP） ，以支持各种数字音频应用，包括杜比定向逻辑，
ATRAC和卢卡斯电影公司主页THX处理。软件，这些应用由许可
摩托罗拉集成到产品如音频/视频接收机，电视机和汽车
音响系统与这些用户开发的特性为数字均衡和音场
处理。该DSP56004是MPU式通用DSP ，一个高效的24位组成
数字信号处理器核心，程序和数据存储器，各种外围设备以优化
音频和支持电路。如图
图1
的DSP56000内核系列兼容
DSP由程序存储器供给，两个独立的数据RAM和两个数据ROM中，串行
音频接口（ SAI ） ，串行主机接口（SHI ） ，外部存储器接口（ EMI ） ，专用
I / O口线，片上锁相环（ PLL ）和片上仿真（一次
）端口。
4
一般
用途
输入/
产量
飞思卡尔半导体公司...
9
串行
音频
接口
（ SAI ）
5
串行
主持人
接口
（ SHI）
29
外
内存
接口
（EMI）的
16位总线
24位总线
节目
内存*
X数据
内存*
Y数据的
内存*
24-Bit
DSP56000
CORE
地址
GENERATION
单位
PAB
XAB
YAB
GDB
国内
数据
公共汽车
开关
PDB
XDB
YDB
一旦
TM
PORT
时钟
将军
打断
控制
节目
解码
调节器
程序控制单元
节目
地址
发电机
PLL
数据ALU
24
×
24 + 56
→
56位MAC地址
两个56位累加器
3
4
4
IRQA
,
IRQB ， NMI
,
RESET
*请参阅表1的内存配置。
AA0248
图1
DSP56004框图
1996年，1997 MOTOROLA ， INC 。
欲了解更多有关该产品，
转到： www.freescale.com
飞思卡尔半导体公司
目录
第1节
第2节
第3节
第4节
第5节
SIGNAL /连接描述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-1
规格。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-1
包装。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-1
设计注意事项。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-1
订购信息。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 5-1
飞思卡尔半导体公司...
提供技术援助：
电话：
电子邮件：
互联网：
1-800-521-6274
dsphelp@dsp.sps.mot.com
http://www.motorola-dsp.com
数据表约定
本数据手册使用以下约定：
横线
“断言”
“无效”
示例：
用于指示信号的情况下被置于低电平（例如处于活动状态，则复位
引脚为低电平有效。 ）
意味着一个高真（高电平有效）信号为高或低真（低电平有效）
信号为低
意味着一个高真（高电平有效）信号为低或低真（低电平有效）
信号为高
信号/符号
针
针
针
针
注意：
逻辑状态
真
假
真
假
信号状态
断言
拉高
断言
拉高
电压
V
IL
/V
OL
V
IH
/V
OH
V
IH
/V
OH
V
IL
/V
OL
值V
IL
, V
OL
, V
IH
和V
OH
个别产品的规格定义。
ii
DSP56004 / D ，第3版
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摩托罗拉
飞思卡尔半导体公司
DSP56004
特点
特点
数字信号处理芯
与24位的DSP56000核心引擎兼容高效，目标代码
高达40.5每秒百万条指令（ MIPS ） -24.7 ns指令周期为
81兆赫;高达324万次运算每秒（ MOPS ）在81兆赫
高度并行的指令集和独特的DSP寻址模式
两个56位累加器，包括扩展字节
并行24
×
24位乘法累加在1个指令周期（ 2个时钟周期）
双精度48
×
96位结果的48位乘法的6个指令周期
56位加法/减法在1个指令周期
小数和整数运算与多倍精度运算的支持
用于块浮点快速傅立叶变换的硬件支持（FFT）的
硬件嵌套DO循环
零开销快速中断（ 2个指令周期）
4个24位内部数据总线和3个16位内部地址总线为
同时存取一个节目和两个数据存储器
制造的高密度CMOS
飞思卡尔半导体公司...
内存
片上改进的哈佛结构，它允许同时访问
编程和两个数据存储器
自举加载方式，从串行主机接口或外部存储器接口
表1
内存配置（字宽为24位）
节目
部件类型
只读存储器
DSP56004
1
DSP56004ROM
2
注意：
1.
2.
X数据
只读存储器
256
256
内存
256
256
Y数据的
只读存储器
256
256
内存
256
256
内存
512
256
自举
只读存储器
64
64
无
2560
X数据的ROM被编程以
登录
2
x
和
2
x
表
; Y数据ROM被编程为正弦表。
这些ROM可工厂编程与应用程序开发人员提供的数据/程序。
摩托罗拉
DSP56004 / D ，第3版
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iii
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DSP56004
特点
外围设备和支持电路
串行音频接口（ SAI ）包括两个接收器和三个发射器，
主站或从站功能，实现了我
2
S，索尼，松下和音频
协议;和两套SAI的中断向量
串行主机接口（ SHI）功能的单主机的能力， 10个字的接收
FIFO中，并且为8-支撑位，16位和24位字
外部存储器接口（EMI），实现为外围支撑：
–
页面模式的DRAM （一个或两个芯片） ： 64千
×
4, 256 K
×
4,
和4M
×
4位
的SRAM （一至四个） ： 256千
×
8位
数据总线可以是4或8比特宽
数据字可以是8，12， 16，20或24比特宽
飞思卡尔半导体公司...
–
–
–
四个专用的，独立的，可编程的通用输入/输出
（ GPIO ）线
片上外设寄存器的内存映射到数据存储空间
三个外部中断请求引脚
片上仿真（一次）端口不显眼，处理器速度 -
独立调试
软件编程，锁相环基于（PLL）频率合成器
为内核时钟
省电待机和停止模式
完全静态的， HCMOS设计的工作频率降低到直流
80引脚塑料四方扁平封装表面贴装封装; 14
×
14
×
2.20 mm
（ 2.15-2.45毫米范围内） ; 0.65毫米引线间距
DSP56004 ， DSP56004ROM之间的完全兼容的引脚排列，
DSP56007和DSP56009轻松升级
5 V电源
iv
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摩托罗拉
飞思卡尔半导体公司
DSP56004
产品文档
产品文档
表2
列出了提供的DSP56004的完整说明和文档
必须正确地设计与一部分。文档可从本地
摩托罗拉分销商，摩托罗拉半导体销售办事处，摩托罗拉文学
配送中心，或通过互联网上的摩托罗拉DSP主页（该
来源为最新的信息） 。
表2
DSP56004文档
文件名称
内容简介
DSP56000内核系列的架构和24位
核心处理器和指令集
内存，外围设备和接口
电气和时序特定连接的阳离子，
和引脚和封装描述
订单号
DSP56KFAMUM/AD
DSP56004UM/AD
DSP56004/D
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DSP56000系列
手册
DSP56004用户
手册
DSP56004技术
数据
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SYMPHONY
音频DSP系列
24位的数字信号处理器
摩托罗拉设计了交响乐系列高性能，可编程的数字信号
处理器（DSP） ，以支持各种数字音频应用，包括杜比定向逻辑，
ATRAC和卢卡斯电影公司主页THX处理。软件，这些应用由许可
摩托罗拉集成到产品如音频/视频接收机，电视机和汽车
音响系统与这些用户开发的特性为数字均衡和音场
处理。该DSP56004是MPU式通用DSP ，一个高效的24位组成
数字信号处理器核心，程序和数据存储器，各种外围设备以优化
音频和支持电路。如图
图1
的DSP56000内核系列兼容
DSP由程序存储器供给，两个独立的数据RAM和两个数据ROM中，串行
音频接口（ SAI ） ，串行主机接口（SHI ） ，外部存储器接口（ EMI ） ，专用
I / O口线，片上锁相环（ PLL ）和片上仿真（一次
）端口。
4
一般
用途
输入/
产量
9
串行
音频
接口
（ SAI ）
5
串行
主持人
接口
（ SHI）
29
外
内存
接口
（EMI）的
16位总线
24位总线
节目
内存*
X数据
内存*
Y数据的
内存*
24-Bit
DSP56000
CORE
地址
GENERATION
单位
PAB
XAB
YAB
GDB
国内
数据
公共汽车
开关
PDB
XDB
YDB
一旦
TM
PORT
时钟
将军
打断
控制
节目
解码
调节器
程序控制单元
节目
地址
发电机
PLL
数据ALU
24
×
24 + 56
→
56位MAC地址
两个56位累加器
3
4
4
IRQA
,
IRQB ， NMI
,
RESET
*请参阅表1的内存配置。
AA0248
图1
DSP56004框图
1996年，1997 MOTOROLA ， INC 。
目录
第1节
第2节
第3节
第4节
第5节
SIGNAL /连接描述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-1
规格。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-1
包装。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-1
设计注意事项。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-1
订购信息。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 5-1
提供技术援助：
电话：
电子邮件：
互联网：
1-800-521-6274
dsphelp@dsp.sps.mot.com
http://www.motorola-dsp.com
数据表约定
本数据手册使用以下约定：
横线
“断言”
“无效”
示例：
用于指示信号的情况下被置于低电平（例如处于活动状态，则复位
引脚为低电平有效。 ）
意味着一个高真（高电平有效）信号为高或低真（低电平有效）
信号为低
意味着一个高真（高电平有效）信号为低或低真（低电平有效）
信号为高
信号/符号
针
针
针
针
注意：
逻辑状态
真
假
真
假
信号状态
断言
拉高
断言
拉高
电压
V
IL
/V
OL
V
IH
/V
OH
V
IH
/V
OH
V
IL
/V
OL
值V
IL
, V
OL
, V
IH
和V
OH
个别产品的规格定义。
ii
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DSP56004
特点
特点
数字信号处理芯
与24位的DSP56000核心引擎兼容高效，目标代码
高达40.5每秒百万条指令（ MIPS ） -24.7 ns指令周期为
81兆赫;高达324万次运算每秒（ MOPS ）在81兆赫
高度并行的指令集和独特的DSP寻址模式
两个56位累加器，包括扩展字节
并行24
×
24位乘法累加在1个指令周期（ 2个时钟周期）
双精度48
×
96位结果的48位乘法的6个指令周期
56位加法/减法在1个指令周期
小数和整数运算与多倍精度运算的支持
用于块浮点快速傅立叶变换的硬件支持（FFT）的
硬件嵌套DO循环
零开销快速中断（ 2个指令周期）
4个24位内部数据总线和3个16位内部地址总线为
同时存取一个节目和两个数据存储器
制造的高密度CMOS
内存
片上改进的哈佛结构，它允许同时访问
编程和两个数据存储器
自举加载方式，从串行主机接口或外部存储器接口
表1
内存配置（字宽为24位）
节目
部件类型
只读存储器
DSP56004
1
DSP56004ROM
2
注意：
1.
2.
X数据
只读存储器
256
256
内存
256
256
Y数据的
只读存储器
256
256
内存
256
256
内存
512
256
自举
只读存储器
64
64
无
2560
X数据的ROM被编程以
登录
2
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和
2
x
表
; Y数据ROM被编程为正弦表。
这些ROM可工厂编程与应用程序开发人员提供的数据/程序。
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iii
DSP56004
特点
外围设备和支持电路
串行音频接口（ SAI ）包括两个接收器和三个发射器，
主站或从站功能，实现了我
2
S，索尼，松下和音频
协议;和两套SAI的中断向量
串行主机接口（ SHI）功能的单主机的能力， 10个字的接收
FIFO中，并且为8-支撑位，16位和24位字
外部存储器接口（EMI），实现为外围支撑：
–
–
–
–
页面模式的DRAM （一个或两个芯片） ： 64千
×
4, 256 K
×
4,
和4M
×
4位
的SRAM （一至四个） ： 256千
×
8位
数据总线可以是4或8比特宽
数据字可以是8，12， 16，20或24比特宽
四个专用的，独立的，可编程的通用输入/输出
（ GPIO ）线
片上外设寄存器的内存映射到数据存储空间
三个外部中断请求引脚
片上仿真（一次）端口不显眼，处理器速度 -
独立调试
软件编程，锁相环基于（PLL）频率合成器
为内核时钟
省电待机和停止模式
完全静态的， HCMOS设计的工作频率降低到直流
80引脚塑料四方扁平封装表面贴装封装; 14
×
14
×
2.20 mm
（ 2.15-2.45毫米范围内） ; 0.65毫米引线间距
DSP56004 ， DSP56004ROM之间的完全兼容的引脚排列，
DSP56007和DSP56009轻松升级
5 V电源
iv
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产品文档
产品文档
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必须正确地设计与一部分。文档可从本地
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配送中心，或通过互联网上的摩托罗拉DSP主页（该
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数据
内容简介
DSP56000内核系列的架构和24位
核心处理器和指令集
内存，外围设备和接口
电气和时序特定连接的阳离子，
和引脚和封装描述
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