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飞思卡尔半导体公司
SIGNAL /连接描述
时钟和PLL信号
时钟和PLL信号
注意：
而在PLL上该DSP是相同的，在所描述的锁相环
DSP56000
家庭手册
两个信号都没有被外部实现。
具体地，不存在PLOCK信号或可用CKOUT信号。因此，
内部时钟是不能直接访问的，并且没有外部指示
该PLL被锁定。这些信号被省略，以减少数
销，并允许该DSP被放在一个更小，更便宜的封装。
表1-4
时钟和PLL信号
飞思卡尔半导体公司...
信号
名字
EXTAL
信号
TYPE
输入
状态
中
RESET
输入
信号说明
外部时钟/水晶这
输入应连接到一个
外部时钟源。如果PLL使能时，此信号
内部连接到片上PLL 。该PLL可以繁殖
在EXTAL销的频率，以产生内部DSP的
时钟。 PLL的输出被分成两部分，以产生一个四相
指令周期时钟，以最小指令执行时间为
两个PLL输出时钟周期。如果PLL被禁用，是EXTAL
二分频，产生四相，指令周期时钟。
PLL滤波电容，这
输入用于连接一个高
质量（高的“Q”因数）所需的PLL外部电容
过滤器。该电容应尽量靠近，与DSP
沉重的，短的走线连接电容的一个终端
PCAP和另一个端子到V
CCP
。所需的电容
值在规定的
表2-6
在第2-6页。
注意：
当短的锁定时间是非常关键的，低介电吸收
电容器，例如聚苯乙烯，聚丙烯或聚四氟乙烯的
推荐使用。
PCAP
输入
输入
如果PLL不使用（即，它仍然禁用时刻） ，有
无需电容器连接到PCAP引脚。它可以保持
未连接，或绑在V
cc
或GND 。
PINIT
输入
输入
PLL初始化（ PINIT ） -During
硬件的断言
复位后，就PINIT线的值写入的PEN位
PCTL寄存器。设置时， PEN位使能PLL通过使
它从PLL压控导出的内部时钟
振荡器的输出。当该位被清零时，PLL被禁用，
DSP的内部时钟被从连接到该时钟导出
在EXTAL信号。硬件复位后为无效时，
PINIT信号被忽略。
1-4
DSP56004 / D ，第3版
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