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CS5165A
保持这种状态，直到过压状态停止或
输入电压被拉低。底部FET和电路板走线
必须妥善设计来实现OVP function.If
一个专用的OVP输出是必需的，它可以被实现
使用该电路在图22中。在该图中的OVP信号将
高（过压状态） ，如果输出电压（V
CORE
)
超过电压由特定DAC码设置为20％和
只要PWRGD低。还要求该
过压状态可存在于至少PWRGD延迟
被激活的时间时OVP信号。电阻值
在图22中示出的是对于V
DAC
= 2.8 V（ DAC = 10111 ） 。
在V
OVP
（过电压跳闸点），可以使用设置
下面的等式：
VOVP
+
VBEQ3 1
)
R2
R1
V
CORE
15 k
+5.0 V
56 k
5.0 k
OVP
+5.0 V
20 k
10 k
Q1
2N3906
Q2
2N3904
10 K
R1
Q3
2N3906
R2
CS5165A
PWRGD
10 k
图22.电路来实现一个专门的OVP
输出使用CS5165A
输出使能电路
的使能引脚（引脚8 ）用于使能或禁止
稳压器的输出电压，并且是带TTL直流一致
规格。据内部上拉了起来。如果拉低（以下
0.8 V）时，输出电压被禁用。在同一时间的
电源良好和软启动引脚被拉低，这样，当
恢复正常运行加电时， CS5165A的云
通过软启动序列。当拉使能引脚
低，内部集成电路偏压被完全关断，从而导致
控制器IC的总关机。
M 10.0
ms
跟踪4- 5.0 V的PC电源（ 5.0 V / DIV 。 ）
追查1稳压器输出电压（ 1.0 V / DIV 。 ）
追踪2-电感开关节点5.0 V / DIV 。 ）
电源良好电路
图20. OVP响应一个输入 - 输出
短路，立即提供0 ％占空比
周期，乌鸦，除非输入电压对地
电源良好引脚（引脚13 ）是一个集电极开路信号
与TTL DC规格一致。这是外部
向上拉动的，并且被拉低（低于0.3V）时，该调节器
输出电压通常超过
±
8.5额定输出的百分比
电压。电源之前，最大输出电压偏差
好被拉低的
±
12%.
M 5.00毫秒
跟踪4- 5.0 V的PC电源（ 2.0 V / DIV 。 ）
追查1稳压器输出电压（ 1.0 V / DIV 。 ）
跟踪2- PWRGD （ 2.0 V / DIV 。 ）
跟踪4- V
OUT
（ 1.0 V / DIV 。 ）
图21. OVP响应输入到输出短路
电路通过将输入电压对地
图23. PWRGD信号变为逻辑高电平为
V
OUT
进入的低门槛PWRGD -8.5 ％ ，
V
OUT
= 2.84 V（ DAC = 10111 ）
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