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CS5101A CS5102A
4.5
模拟输入范围/编码格式
小人0.5 LSB以上-VREF ，最后过渡
出现1.5个LSB低于+ VREF 。该CS5101A及
CS5102A可在任一2的补码输出数据
换货或二进制格式。如果代码引脚为高电平时，
输出为2的补码格式，射程
-32,768到+32,767 。如果代码引脚为低电平时，输出
放是结合到65535的范围为0的二进制格式。
表1给出了输出编码。
两公司
补
7FFF
7FFF
7FFE
0000
FFFF
8001
8000
8000
参考电压直接定义输入
在这两个单极和双极CON-电压范围
音型。在单极性配置
（ BP / UP低） ，第一个代码转换发生
0.5 LSB以上AGND ，最后一个码转换
出现1.5个LSB以下VREF 。在双极型CON-
成形（ BP / UP的高点） ，第一个代码转换OC-
OFFSET
二进制
FFFF
FFFF
FFFE
8000
7FFF
0001
0000
0000
表1.输出编码
单极性输入电压
> （ VREF - 1.5 LSB ）
VREF - 1.5 LSB
（ VREF / 2 ） -0.5 LSB
0.5 LSB
< （ +0.5 LSB ）
双极性输入电压
> （ VREF - 1.5 LSB ）
VREF - 1.5 LSB
-0.5 LSB
-VREF + 0.5 LSB
< （ -VREF + 0.5 LSB ）
4.6
输出模式控制
的SCKMOD和OUTMOD引脚的状态。在所有
模式下，数据在SDATA输出，开始与
MSB 。每个后续的数据位被更新的
SCLK下降沿边缘。
该CS5101A和CS5102A可以在被配置
三种不同的输出模式，以及一个内部
同步环回模式。这使得大
灵活设计成各种不同的系统。
工作模式选择通过设置
模式
太平洋夏令时
彩铃
SSC
FRN
表2.输出模式控制
SCKMOD
1
1
0
0
OUTMOD
1
0
1
0
SCLK
输入
输入
产量
产量
CH1/2
输入
输入
输入
产量
HOLD
输入
输入
输入
X
当SCKMOD高， SCLK为输入，使
数据可以同步输出与外部串行
速率高达5 MHz的时钟。额外的时钟边缘
后＃ 16日将时钟输出逻辑1的SDATA 。绑
SCKMOD重新配置低SCLK为输出，
和转换器时钟出每个比特，它是阻止 -
在转换过程中开采的，在一个速率
1/4主时钟速度。表2示出了
SCKMOD的不同状态的概述和
OUTMOD ，和对应的输出模式。
4.6.1
流水线数据传输
PDT模式通过搭售既SCKMOD和
OUTMOD高。在PDT模式下， SCLK引脚为
输入。数据转换过程中注册，并
在下面的转换周期的输出。
HOLD必须拉低，启动另一个CON-
版本之前，从以前的数据转换
可在SDATA 。如果所有的数据尚未
同步输出HOLD的下一个下降沿之前，
旧的数据将会丢失（图5） 。
DS45F6
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