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怀特电子设计
V
CC
= +1.8V ± 0.1V
AC特性
参数
CL = 6
CL = 5
CL = 4
CL = 3
符号
t
对照（6）
t
对照（5）
t
对照（4）
t
CK （3）
t
CH
t
CL
t
HP
t
J
I
T
t
AC
t
HZ
t
LZ
t
DS
t
DH
t
D
I
PW
t
QHS
t
QH
t
DVW
t
DQSH
t
DQSL
t
DQSCK
t
DSS
t
DSH
t
DQSQ
t
RPRE
t
RPST
t
WPRES
t
WPRE
t
WPST
t
DQSS
t
IPW
t
IS
t
IH
t
CCD
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
WV3HG64M72EER-PD4
先进
AC时序参数&规格
806
民
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
665
最大
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
534
最大
8,000
8,000
8,000
0.55
0.55
125
+450
民
最大
民
403
最大
单位
ps
ps
ps
ps
t
CK
t
CK
ps
ps
ps
ps
ps
民
3,000
3,750
5,000
0.45
0.45
民
(t
CH ，
t
CL
)
-125
-450
时钟周期时间
时钟
3,750
5,000
0.45
0.45
民
(t
CH ，
t
CL
)
-125
-500
8,000
8,000
0.55
0.55
125
+500
t
交流电压（最大）
5,000
5,000
0.45
0.45
民
(t
CH ，
t
CL
)
-125
-600
8,000
8,000
0.55
0.55
125
+600
t
交流电压（最大）
CK高电平宽度
CK低电平宽度
半个时钟周期
时钟抖动
从CK / CK ＃ DQ输出访问时间
从数据输出高阻抗窗口
CK / CK ＃
从数据输出低阻抗窗口
CK / CK ＃
DQ和DM输入建立时间相对于
的DQ
DQ和DM输入保持相对DQS时间
DQ和DM输入脉冲宽度（对于每个
INPUT）
数据保持倾斜因子
DQ ... DQS持有， DQS到FI RST DQ去
nonvalid ，每次访问
数据有效输出窗口（ DVW ）
DQS输入高电平脉冲宽度
DQS输入低脉冲宽度
从CK / CK ＃ DQS输出访问时间
DQS下降沿到CK上升 - 建立时间
DQS下降沿从CK上升沿举行...
时间
DQS -DQ歪斜， DQS到最后DQ有效的，每
集团
每次访问
DQS读序言
DQS阅读后同步
DQS写序言建立时间
DQS写序言
DQS写后同步
写命令到连接的第一个DQS锁存
过渡
地址和控制输入脉冲宽度为
每个输入
地址和控制输入建立时间
地址和控制输入保持时间
地址和控制输入保持时间
t
交流电压（最大）
t
AC （分钟）
100
225
0.35
340
t
惠普 -
t
QHS
t
QH -
t
DQSQ
0.35
0.35
-400
0.2
0.2
240
0.9
0.4
0
0.35
0.4
WL-
0.25
0.6
200
275
2
1.1
0.6
0.9
0.4
0
0.35
0.4
WL-
0.25
0.6
250
375
2
t
惠普 -
t
QHS
t
QH -
t
DQSQ
0.35
0.35
-450
0.2
0.2
t
交流电压（最大）
t
AC （分钟）
100
225
0.35
待定
待定
t
交流电压（最大）
t
AC （分钟）
150
275
0.35
t
交流电压（最大）
待定
待定
数据
待定
待定
待定
待定
t
CK
450
ps
ps
ns
t
CK
t
CK
ps
t
CK
t
CK
350
ps
t
CK
t
CK
ps
t
CK
t
CK
t
CK
t
CK
ps
ps
t
CK
待定
待定
待定
待定
400
t
惠普 -
t
QHS
t
QH -
t
DQSQ
0.35
0.35
-500
0.2
0.2
300
1.1
0.6
0.9
0.4
0
0.35
0.4
WL-
0.25
0.6
350
475
2
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
待定
+400
+450
+500
数据选通
待定
待定
1.1
0.6
0.6
WL +
0.25
0.6
WL +
0.25
0.6
WL +
0.25
待定
待定
待定
待定
待定
待定
待定
待定
* AC特定网络连接的阳离子是基于
三星
组件。其它DRAM制造特定网络连接的阳离子可以是不同的。
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2006年4月
第1版
7
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