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ADSP-21362/ADSP-21363/ADSP-21364/ADSP-21365/ADSP-21366
内存写并行端口
使用这些规范的异步接口连接到memo-
里斯（和内存映射外设）的时候
ADSP- 2136x正在访问外部存储器空间。
表24. 8位存储器写周期
参数
开关特性
ALE脉冲宽度
t
ALEW
t
ADAS
1
AD15-0地址设置ALE拉高之前
t
ALERW
ALE拉高写的断言
t
RWALE
写拉高到ALE断言
t
WRH
间WR上升沿延迟到明年WR下降沿
1
t
亚大
AD15-0地址保持ALE拉高后
WR脉冲宽度
t
WW
t
ADWL
AD15-8地址到WR低
t
ADWH
AD15-8地址保持WR高后
t
DWS
AD7-0数据建立WR高前
t
DWH
AD7-0数据保持WR高后
t
DAWH
AD15-8地址到WR高
D = （数据周期持续时间=由PPDUR位（ 5-1 ）在PPCTL寄存器中设置的值）
×
t
PCLK
.
H =吨
PCLK
（如果指定的保持周期，否则H = 0 ）
F = 7
×
t
PCLK
（如果FLASH_MODE被设置，否则F = 0） 。如果FLASH_MODE设置， D必须
≥
9
×
t
PCLK
.
t
PCLK
= （外设）时钟周期= 2
×
t
CCLK
1
民
2 × t
PCLK
– 2.0
t
PCLK
– 2.8
2 × t
PCLK
– 3.8
H + 0.5
F + H +吨
PCLK
– 2.3
t
PCLK
– 0.5
- F - 2.0
t
PCLK
– 2.8
H
- F +吨
PCLK
– 4.0
H
- F +吨
PCLK
– 4.0
最大
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
复位时， ALE为高电平有效循环。但是，它可以通过软件被配置为低电平有效。
ALE
t
ALEW
t
ALERW
t
RWALE
t
WW
WR
t
ADWL
t
DAWH
RD
t
WRH
t
ADAS
AD15-8
t
亚大
t
ADWH
有效
地址
有效的地址
有效的地址
t
DWH
t
DWS
AD7-0
有效
地址
有效数据
有效数据
注：内存写入总是发生在四组
ALE之间的回路。此图仅显示两个内存
写为了提供必要的定时信息。
图20.写周期为8位内存时序
版本A |
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2006年12月
