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初步
集成
电路
系统公司
ICS843002-31
700MH
Z
F
EMTO
C
锁
VCXO B
ASED
F
Characteristic低频
T
RANSLATOR和
J
伊特尔
A
TTENUATOR
D
。微分
C
LOCK
I
NPUT
C
IRCUIT
U
唱
D
。微分
I
用于覆盖整个院落
S
炉火
-E
NDED
C
锁
差动接口（ CLK0 / nCLK0 ）可以用作一个
第三个单端输入，以支持LVCMOS或LVTTL
时钟驱动器。的时钟输入端被连接到所述的CLK0输入
引脚， nCLK0引脚悬空。为了帮助减少
与内部VCO电路的干扰，外部
电阻器可以被放置在一系列邻近的时钟信号
在CLK0输入品脱。结合输入引脚电容
tance ，该电阻器可充当低通滤波器的信号。该
这个可选的过滤器系列电阻的典型值为100Ω 。
这将降低幅度和边缘的速率
时钟输入信号。在很短的时钟的情况下跟踪一
串联端接寄存器可能并不需要。
系列
终止
LVTTL
或LVCMOS
逻辑输出
可选
系列
滤波器
电阻器
3.3V
CLK0
3.3V
CLK
nCLK0
（无连接）
51k
NCLK
51k
51k
迪FF erential
输入级
外部电路
内部器件电路
F
IGURE
5. S
炉火
-E
NDED
C
LOCK
I
NPUT
I
覆盖整个院落
R
ECOMMENDATIONS FOR
U
NUSED
I
NPUT和
O
安输出
P
插件
I
NPUTS
:
O
UTPUTS
:
C
RYSTAL
I
NPUT
:
如果不需要使用晶体振荡器的
输入时，两个XTAL_IN和XTAL_OUT可以悬空。
虽然不是必需的，但对于额外的保护，一个1kΩ
电阻器可连接从XTAL_IN到地面。
CLK我
NPUT
:
如果不需要利用一个时钟输入端，它可以
悬空。虽然不是必需的，但对于附加的
保护，一个1kΩ电阻可以从CLK输入被捆绑
地面上。
CLK / NCLK我
NPUT
:
如果不需要使用差分输入，
无论CLK和NCLK可以悬空。虽然不是必需的，
但对于额外的保护，一个1kΩ的电阻可以从绑
CLK到接地。
LVCMOS
ONTROL
P
插件
:
所有的控制引脚具有内部上拉或下拉功能;另外
不需要性，但可以额外添加
保护。一个1kΩ电阻都可以使用。
843002CY-31
LVCMOS
安输出
:
所有未用的LVCMOS输出可以悬空。我们
建议没有一丝连接。
LVPECL
安输出
所有未使用的LVPECL输出可以悬空。我们
建议没有一丝连接。的两侧
差分输出对应该要么被悬空
终止。
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REV 。 B 2005年11月22日
