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IDT72T54242 / 72T54252 / 72T54262 2.5V QUAD /双TeraSync
DDR / SDR FIFO
32K ×10× 4 / 16K ×20× 2 ， 64K ×10× 4 / 32K ×20× 2和128K ×10× 4 / 64K ×20× 2
商业和工业
温度范围
OUTPUT ENABLE &禁用时序
产量
启用
OE
V
IL
产量
关闭
V
IH
t
OE &
t
OLZ
单路输出
通常
低
V
CC
/2
100mV
t
OHZ
V
CC
/2
V
OL
100mV
单路输出
通常
高
100mV
V
OH
100mV
V
CC
/2
V
CC
/2
t
OE
t
OLZ
t
OHZ
在输出寄存器的当前数据
输出总线
注意事项：
1.
任
为高。
2.
RCS
是低的。
V
CC
/2
V
CC
/2
6158 drw05
读片选ENABLE & DISABLE时序
RCS
t
ENS
RCLK
t
RCSLZ
单输出V
CC
通常
2
低
t
RCSHZ
V
CC
2
V
OL
t
ENH
V
IH
V
IL
100mV
100mV
单路输出
通常V
CC
2
高
100mV
100mV
V
OH
V
CC
2
V
CC
2
6158 drw06
t
RCSLZ
输出总线V
CC
2
t
OLZ
在输出寄存器的当前数据
t
OHZ
注意事项：
1.
任
为高。
2.
OE
是低的。
16
2005年3月22日
