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IDT72V3656 / 72V3666 / 72V3676 3.3V CMOS三路BUS SyncFIFO
TM
与总线匹配2048 ×36× 2 ， 4096 ×36× 2和8192 ×36× 2
商业级温度范围
t
CLK
t
CLKH
CLKC
t
ENS2
MBC
t
ENS2
WENC
IRC
C0-C17
CLKA
ORA
CSA
W / RA
工商管理硕士
ENA
t
A
A0-A35
旧数据在FIFO2输出寄存器
W1
4665 drw19
t
CLKL
t
ENH
t
ENH
高
t
DS
写1
t
DH
t
DS
写2
t
DH
(1)
t
SKEW1
t
CLK
t
CLKH
t
CLKL
1
2
3
t
REF
t
REF
FIFO2空
低
低
低
t
ENS2
t
ENH
注意事项：
1. t
SKEW1
是一个上升CLKC边缘与上升CLKA边缘为ORA之间的最小时间来过渡HIGH和到时钟的下一个单词的FIFO2的输出寄存器中的3 CLKA
周期。如果CLKC边缘和上升CLKA边缘之间的时间小于吨
SKEW1
，然后ORA高电平的第一个字的负载给输出寄存器中的过渡，并且可以发生
1 CLKA周期晚于所示。
2.如果端口C的大小是字或字节，T
SKEW1
被引用到上升CLKC边缘写入的长型字的最后一个字或字节写入，分别。
图18. ORA标志时序和第一个数据字告吹时FIFO2是空的（ FWFT模式）
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