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电气规格
表5-26 。和McBSP1的McBSP2的开关特性
号
MC1
MC3
MC4
MC11
MC12
MC13
MC14
MC15
TC （ CKRX ）
TR （ CKRX ）
TF （ CKRX ）
总重量（ CKRXH ）
总重量（ CKRXL ）
TD （ CKRH - FRV ）
TD （ CKXH - FXV ）
周期时间， CLKR / X
上升时间， CLKR / X
下降时间， CLKR / X
脉冲持续时间， CLKR / X高
脉冲持续时间， CLKR / X低
延迟时间， CLKR高到内部FSR有效
延迟时间， CLKX高到内部FSX有效
参数
CLKR / X INT
CLKR / X INT
CLKR / X INT
CLKR / X INT
CLKR / X INT
CLKR INT
CLKR分机
CLKX INT
CLKX分机
CLKX INT
TDIS （ CKXH - DXHZ ）禁止时间，从CLKX DX高阻抗较高下最后一个数据位
延迟时间， CLKX高到DX有效。
这适用于所有的比特以外发送的第一个位。
MC16
TD （ CKXH - DXV ）
延迟时间， CLKX高到DX valid
DXENA = 0
CLKX分机
CLKX INT
CLKX分机
CLKX INT
CLKX分机
CLKX INT
CLKX分机
CLKX INT
CLKX分机
CLKX INT
CLKX分机
FSX INT
FSX分机
FSX INT
FSX分机
FSX INT
FSX分机
FSX INT
FSX分机
1
8
P1
P+8
2
9
P2
P+9
3
13
2P + 1
2P + 12
D 2§
C 2§
3
3
3
4
3
10
民
2P
2
2
D + 2§
C + 2§
2
14
2
15
3
19
5
15
4
15
2P + 1
2P + 5
ns
ns
ns
ns
最大
单位
ns
ns
ns
ns
ns
只适用于第一位的数据延迟DXENA = 1时发送
1或2（ XDATDLY条件= 01b或10b）的模式
启用时间， DX从CLKX high驱动
DXENA = 0
MC17
10 （ CKXH - DX ）
只适用于第一位的数据延迟DXENA = 1时发送
1或2（ XDATDLY条件= 01b或10b）的模式
延迟时间， FSX高到DX valid
DXENA = 0
只适用于第一位的数据延迟DXENA = 1时发送
0 （ XDATDLY = 00B ）模式。
启用时间， DX从FSX high驱动
DXENA = 0
只适用于第一位的数据延迟DXENA = 1时发送
0 （ XDATDLY = 00B ）模式
ns
MC18
TD （ FXH - DXV ）
ns
MC19
10 （ FXH - DX ）
ns
极性位CLKRP = CLKXP = FSRP = FSXP = 0。如果任何的信号的极性反转，则该信号的定时参考文献是
也反转。
P = 1 / CPU的时钟频率。例如，在108 MHz的运行部件时，使用P = 9.26纳秒。
§ T = CLKRX周期= （ 1 + CLKGDV ） * P
C = CLKRX低脉冲宽度= T / 2时， CLKGDV是奇数或零和= （ CLKGDV / 2 ） * P时CLKGDV是偶数
D = CLKRX高脉冲宽度= T / 2时CLKGDV是奇数还是零和= （ CLKGDV / 2 + 1） * P当CLKGDV是偶数
见
的TMS320C55x DSP外设概述参考指南
（文献编号SPRU317 ）的DX启用的描述（ DXENA ）
和数据延迟的多通道缓冲串口的功能。
2006年10月 - 修订2008年1月
SPRS375C
99
