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ADC081500
2.0应用信息
(续)
输入必须具有较低的RMS抖动。允许的抖动是
输入频率和输入信号电平,作为功能
在第2.3节。
这是很好的做法,以保持ADC的输入时钟线尽量短
有可能,以保持它远离任何其他信号
把它作为传输线。其他信号可以介绍
抖动到输入时钟信号。该时钟信号还可以
噪声引入模拟路径,如果不从隔离
路径。
为获得最佳的动态性能,当暴露
垫在封装的后面有一个良好的连接
地面上。这是因为从模头到地该路径是一个
较低的阻抗比所提供的封装引脚。
2.9使用串行接口
该ADC081500可以正常对照进行操作
模式(使用控制引脚)或在扩展控制模式
(使用串行接口和寄存器设置) 。
表5
6
描述在销3 ,4, 14和127的功能
正常控制模式和扩展的控制方式,重新
spectively 。
2.9.1正常控制模式操作
正常控制模式的操作装置,该串行接口
脸是不活动的,所有的控制功能进行控制
各种引脚设置。即,在满量程范围,单
端或差分输入和输入耦合( ac或dc )是
所有的控制,脚设置。正常控制模式
用于通过设置销14的高或低,而不是让它
FL燕麦。
表5
表明在ADC081500的引脚功能
在正常控制模式。
表5.正常控制模式操作(引脚14高
或低)
3
4
127
14
0.50 V
P-P
产量
OutEdge =
CalDly低
650毫伏
P-P
输入范围
0.70 V
P-P
产量
OutEdge =
POS
CalDly高
870毫伏
P-P
输入范围
漂浮的
不适用
DDR
不适用
EXTENDED
控制
模式
表6.扩展控制模式操作(引脚14
浮动)
3
4
127
功能
SCLK (串行时钟)
SDATA (串行数据)
SCS (串行接口芯片选择)
2.10共同申请问题
驱动输入(模拟或数字)之外的功率
电源轨。
对于设备的可靠性,无输入应该去更多
超过150毫伏以下的接地引脚或150毫伏以上
电源引脚。超过上即使是短暂的依据,这些限制
不仅可能会导致故障或不稳定的操作,但可能
影响器件的可靠性。它并非罕见的高速
数字电路呈现下冲其变为一个多
伏在地面以下。控制高速的阻抗
线并终止于它们的特征im-这些线
pedance应控制过冲。
应注意不要过载的输入
ADC081500 。这种做法可能会导致不准确的转换
政体甚至设备损坏。
不正确的模拟输入端的共模电压在直流
耦合方式。
正如在1.3节和3.0的讨论
输入共模电压必须保持在50毫伏的
在V
CMO
输出,其具有随温度而变
这也必须被追踪。失真性能会
如果输入的共模电压是超过50退化
毫伏从V
CMO
.
使用不适当的放大器来驱动模拟输入。
在选择高频放大器来驱动使用护理
在ADC081500尽可能多的高速放大器会
失真比将在ADC081500较高,导致过度
所有系统的性能下降。
驱动V
BG
引脚,以改变基准电压。
As
在2.1节中所提到的,参考电压是为了
被固定,以提供两种不同的满刻度值中的一个
( 650毫伏
P-P
和870毫伏
P-P
) 。在推动这一引脚将不会
改变它的满刻度值,但也可以用来改变
通过把LVDS的共模电压从0.8V到1.2V
V
BG
引脚到V
A
.
驱动时钟输入和一个过高的水平
信号。
ADC输入时钟电平不应超过
在工作额定值表或输入电平描述
抵消可能改变。
不足的输入时钟的水平。
正如2.3节所述,
不足的输入时钟级别可能会导致性能不佳。
过大的输入时钟的水平可能导致引入
输入的偏移量。
使用的时钟源抖动过大,使用
过长的输入时钟信号的跟踪,或具有
耦合到所述输入时钟信号跟踪的其它信号。
这将导致在抽样间隔来变化,致使exces-
西伯输出噪声和信噪比性能的降低。
如果不能提供足够的热量去除。
如上述
2.6.2节,它是重要的,以提供足够的热重
MOVAL ,以确保设备的可靠性。这既可以做
用足够的空气流,或使用简单的散热器的内置
进入董事会。背面板应接地的
最佳的性能。
销3可以是高或低,在正常控制模式。
14脚不能悬空,选择此模式。看
1.2节以获取更多信息。
4脚可高可低,也可以悬空在Normal
控制模式。在正常控制模式下,引脚4高或低
定义了边缘处的输出数据转换。看
有关详细信息,第2.4.3节。如果此引脚悬空,
输出时钟( DCLK )是DDR(双倍数据速率)时钟(见
节1.1.5.3 ),并输出边沿同步irrel-
埃文特,因为数据同步输出两个DCLK边缘。
销127 ,可以在正常控制模式下的高或低,并
设置校准延迟。销127的目的不是要留
浮动。
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