
DS3100的Stratum 3 / 3E时钟卡IC
调整
描述
(第1页)在功能的子弹,改变了“ G.812 I型和III ”到“ G.812类型I , III和IV ” 。
(页7)删除参考IEEE 1596.3标准
表1-1 。
(第9页)更新
图3-1
显示背板走线的时序卡之间去。
(第59页)编辑组
7.10.1
提高清晰度。
(页68-71 )主编节
7.10.5.1, 7.10.5.2, 7.10.6.1,
和
7.10.6.2
澄清的时候
BRCR和BTCR寄存器应该接收成帧器和发送格式化过程中写入
初始化过程。
032907
(第72页)在第
7.10.7.2,
添加文字描述,必须做额外的写
进入或离开2048kHz模式时,优化了BITS刘发射器。
(第80页)重写部分
7.15
是指读者在网络或电信支持最新的
初始化脚本。
(第149页)在BMCR位5和4的描述,改为“未列出的值是不确定的。 ”
与“见
7.10.7.2
对于必须进入或离开时进行写操作的序列
2048 kHz模式“。
(页155 , 156 , 167 , 168 )
BLCR2 , BLCR3 , BRCR5 , BTCR1 :
对于每一个位应始终
被设置为零或设置为1 ,加入了位描述提醒读者的是这些位必须
置零/ 1 。
注册
BCCR5,
位5和位4的更新的描述,以指示该设备压制了
并增加对零的活动监视器,而不是无效。
编辑组
7.7.6
和
DLIMIT1
和
DLIMIT3 : FLLOL
的描述,以指示T4
DPLL的硬限制固定为
±80ppm
并没有被HARDLIM字段来控制。
节
7.7.2,
纠正一个错字要说T4 DPLL只工作在回切模式
而不是“不具有回切模式”。
通过在OFREQ7领域编辑OFREQ1
OCR
寄存器以指示如果T4 DPLL
被配置用于的62.5MHz ,则OFREQ = 1100指定的T4 APLL频率除以10 ,以
得到的25MHz的输出频率。
增加了一个25MHz的行
表7-13 。
In
表10-2 ,
改变了我
DD18
(注2) 129毫安典型, 152毫安最大;改变了我
DD18
(注3)到
130毫安典型, 154毫安最大;改变了我
DD33
(注2) 36毫安典型, 53毫安最大;改变了我
DD33
(注
3) 124毫安典型, 145毫安最大。的改变是必要的,以考虑功率
差分I / O,而不是功能性的转A1部分的消费。也改变了我
DDR1
从29毫安典型值35mA的电流(典型值) 。
In
表10-3
改变VDD到VDDIO的VOH最大规格及注意事项1 。
In
表10-4 ,
改变了V
OHLVDS
到1.45V (典型值) ,最大1.65V ;新增V
OLLVDS
1.1V (典型值) ;变
V
OSLVDS
到1.08V分钟, 1.28V (典型值) , 1.45V最大。
In
表10-5 ,
删除我的规格
IHPECL
我
IILPECL
规范和注意事项2改为VDD到VDDIO 。
In
表10-6
在V
IHAMI
规格,最大改变来自VDD + 0.3至VDDIO + 0.3 ,并删除了
I
AMIOUT
, V
OHAMI
和V
OLAMI
规格,因为在规范
表7-22
和
图7-17
充足
执政的OC8输出信号的性能。
In
表7-13 ,
更新的许多典型的有效值和峰 - 峰抖动号码匹配转速A2的
器件的性能。
In
表7-9 ,
纠正错字, 68.376到68.736 。
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