ICM7228
表3. ICM7228C引脚分配和说明（续）
PIN号
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名字
HEXA / CODE
B / SHUTDOWN
DA2
ID1
ID0
ID2
ID3
数字1
DlGlT 2
数字5
DlGlT 8
V
DD
4 DIGIT
DlGlT 7
DlGlT 6
DIGlT 3
赛格F
赛格
赛格摹
赛格一
V
SS
供应
设备接地或负电源轨。
产量
LED显示屏细分F，D ，G和动力线。
供应
产量
设备正电源轨。
LED显示位数4 ， 7,6和3道线。
产量
LED显示位数1 ， 2 ， 5和8道线。
功能
输入
输入
输入
描述
三电平输入。显示功能控制：高，十六进制解码;浮，代码B
解码;低，振荡器，并显示已禁用。
数位地址输入， 3位， MSB 。
显示的数据输入。
详细说明
系统接口和数据输入模式，
ICM7228A和ICM7228B
该ICM7228A / B设备与兼容
大多数微处理器系统的体系结构。他们快
开关特性使得能够访问它们作为
映射的I / O设备，在必要的无等待状态的存储器
大多数单片机系统。所有ICM7228A / B输入，
包括模式，配备了250ns的最小建立时间和为0ns
保持时间有200ns的最低写入脉冲。输入逻辑
水平TTL和CMOS兼容。图9示出了
从驱动ICM7228A / B通用方法
微处理器总线。到微处理器中，每个设备
似乎是2个独立的I / O地址;控制寄存器
和显示RAM 。两者之间的选择是
由MODE输入的地址线A0驱动来实现的。
输入数据被放置在LD0 - LD7线。在写输入
既作为设备选择和写周期的时序脉冲。看
图1和开关产品规格表写周期
定时参数。
该ICM7228A / B有三个数据输入模式：控制
注册更新，无需RAM的更新，连续8位数
更新和单数字的更新。在所有三种模式控制
字是第一个写脉冲的写输入而
MODE输入为高电平，从而锁存数据到控制
注册。各个位的控制逻辑电平
注册选择关机，解码/无解码，十六进制/代码B，
RAM银行A / B和显示RAM位数的地址，如图
表1和表2 。
该ICM7228A / B显示RAM分为2组，称为
银行A和B.当使用十六进制或代码B显示器
模式，这些RAM库可以单独地选择。这
允许将被存储两个单独的显示数据的集合和
交替显示。请注意， RAM银行选择不
可以在无解码模式，这是因为显示数据
在无解码模式有8比特，但在解码的方案
（十六进制/代码B）只有4位（ LD0 - LD3数据） 。它也应该是
提到的小数点是独立的选
银行，开启小数点仍将对任何银行。
选择在RAM银行通过LD3输入控制。该LD3
逻辑电平（控制寄存器更新中），选择哪家银行
内部RAM的写入和/或显示。
控制寄存器更新不更新RAM
该控制寄存器可在不改变被更新
通过在写输入的单脉冲的显示数据，用MODE
高进来的数据低。如果显示器被解码
（十六进制/代码B） ，然后LD3的值决定了RAM
银行会选择和显示所有8位。
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