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电气和热特性
表25.突发模式时序（续）
符号
t
8
t
9
t
10
t
11
t
12
t
13
t
14
t
15
描述
上升沿之前数据建立
PCI时钟
PCI术后的上升沿数据保持
时钟
CS否定后数据保持
CS断言ACK后断言
CS否定之前的ACK否定
ACK脉冲宽度
TS断言后CS断言
TS脉冲宽度
民
3.6
0
0
-
-
4
LB
*2*(32/DS)*t
PCICK
-
t
PCICK
最大
-
-
(DC+1)*t
PCICK
(WS+1)*t
PCICK
7.0
4
LB
*2*(32/DS)*t
PCICK
2.5
t
PCICK
单位备注SpecID
ns
ns
ns
ns
ns
ns
ns
ns
(3)
(2),(3)
(4)
A7.31
A7.32
A7.33
A7.34
A7.35
A7.36
A7.37
A7.38
注意事项：
1.等待状态（ WS ），可在片选X寄存器进行编程，位域WAITP和WaitX 。它可以在0指定 -
65535.
2.示例：
长突发时，这意味着的片选突发控制寄存器CS相关BERx和SLB位被置位和
爆裂的内部XLB执行。 = > LB = 1
数据总线宽度为8位。 = > DS = 8
± > 4
1
* 2 * （ 32/8 ）= 32 = >的ACK被置为32个PCI周期来传送一个高速缓存行。
等待状态设置为10。 = > WS = 10
1 + 10 + 32 = 43 = > CS被置为43 PCI周期。
3. ACK是输出，并且指示该脉冲串。
4. Deadcycles仅用于中，如果没有仲裁对共享局部总线的其他模块（ ATA或PCI）的发生。如果仲裁
发生在总线可在4个时钟的IPB由其他模块来驱动。
PCI CLK
CS [ X]
ADDR
t
4
t
1
t
2
t
3
t
5
t
7
t
8
t
10
OE
t
6
读/写
数据（ RD ）
t
9
t
11
t
12
t
13
确认
t
14
t
15
TS
图12.时序图，突发模式
MPC5200B数据手册，第1
飞思卡尔半导体公司
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