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初步
EMC646SP16K
4Mx16 CellularRAM的AD- MUX
图17 ：延迟计数器（可变初始延迟，无刷新碰撞）
CLK
V
IH
V
IL
V
IH
V
IL
V
IH
A[21:16]
有效
地址
ADV ＃
V
IL
代码2
A / DQ [ 15 ： 0 ]
V
IH
V
IL
V
IH
V
IL
有效
地址
代码3 （默认）
D0
D1
D2
D3
D4
D5
D6
D7
A / DQ [ 15 ： 0 ]
有效
地址
码4
D0
D1
D2
D3
D4
D5
D6
D7
A / DQ [ 15 ： 0 ]
V
IH
V
IL
有效
地址
D0
D1
D2
D3
不在乎
D4
D5
D6
未定义
表6 ：固定延迟配置代码
BCR [ 13:11 ]
010
011
100
101
110
000
OTHERS
潜伏期
CON组fi guration
CODE
2 （ 3个时钟）
3（4个时钟） -default
4（5个时钟）
5（6个时钟）
6（7个时钟）
8 （ 9个时钟）
版权所有
延迟数（N ）
正常
2
3
4
5
6
8
--
133
33(30ns)
52(19.2ns)
66(15ns)
75(13.3ns)
104(9.62ns)
133(7.5ns)
-
最大输入CLK的频率（MHz）
104
33(30ns)
52(19.2ns)
66(15ns)
75(13.3ns)
104(9.62ns)
-
-
83
33(30ns)
52(19.2ns)
66(15ns)
75(13.3ns)
83(12ns)
-
-
图18 ：延迟计数器（固定延迟）
N-1
周期
周期n
CLK
V
IH
V
IL
t
AA
V
IH
A[21:16]
V
IL
有效
地址
t
AADV
V
IH
ADV ＃
V
IL
V
IH
V
IL
t
CO
t
ACLK
CE＃
A / DQ [ 15 ： 0 ]
V
OH
（READ ）
V
OL
A / DQ [ 15 ： 0 ]
V
OH
（写）
V
OL
有效
产量
t
SP
有效
地址
突发鉴定
（ ADV ＃ = LOW ）
有效
产量
t
HD
有效
输入
有效
产量
有效
产量
有效
产量
有效
输入
有效
输入
有效
输入
不在乎
有效
输入
有效
输入
未定义
27
